[发明专利]基于SOC芯片的时钟树结构的设计方法有效
| 申请号： | 201310073632.6 | 申请日： | 2013-03-08 |
| 公开（公告）号： | CN103218011A | 公开（公告）日： | 2013-07-24 |
| 发明（设计）人： | 廖裕民 | 申请（专利权）人： | 福州瑞芯微电子有限公司 |
| 主分类号： | G06F1/12 | 分类号： | G06F1/12 |
| 代理公司： | 福州市鼓楼区京华专利事务所(普通合伙) 35212 | 代理人： | 宋连梅 |
| 地址： | 350000 福建省*** | 国省代码： | 福建;35 |
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| 摘要： | |||
| 搜索关键词： | 基于 soc 芯片 时钟 结构 设计 方法 | ||
【权利要求书】：
1.基于SOC芯片的时钟树结构的设计方法，其特征在于：包括如下步骤：
在同步时钟路径上找到共同电路部分，将共同部分提取出来，作为第一级时钟产生电路；
将除第一级时钟产生电路外的所有分支的时钟产生电路放到第二级时钟产生电路中。
2.如权利要求1所述的基于SOC芯片的时钟树结构的设计方法，其特征在于：还包括：
如果所述第二级时钟产生电路中仍有后续分支电路的共同电路的共同部分，则将后续分支电路的共同电路的共同部分保留，将除第一、二级时钟产生电路外的所有分支的时钟产生电路放到第三级时钟产生电路中。
3.如权利要求2所述的基于SOC芯片的时钟树结构的设计方法，其特征在于：还包括：
如果第三级时钟产生电路中仍有后续分支电路的共同电路的共同部分，则将后续分支电路的共同电路的共同部分保留，后续分支再作为下一级时钟产生电路；如此不断递归分级，直到不再有分支电路的共同部分为止。
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