[发明专利]通过时钟信号速率调整的信号流控制有效

专利信息
申请号: 201310607286.5 申请日: 2013-10-09
公开(公告)号: CN103713591A 公开(公告)日: 2014-04-09
发明(设计)人: G·W·巴克勒尔;D·W·孟德尔 申请(专利权)人: 阿尔特拉公司
主分类号: G05B19/418 分类号: G05B19/418
代理公司: 北京纪凯知识产权代理有限公司 11245 代理人: 赵蓉民
地址: 美国加*** 国省代码: 美国;US
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摘要:
搜索关键词: 通过 时钟 信号 速率 调整 控制
【权利要求书】:

1.一种用于操作包括第一电路和第二电路的电子器件的方法,其中所述第一电路使用第一时钟信号进行操作,所述第二电路使用第二时钟信号进行操作,并且其中所述第一时钟信号和所述第二时钟信号具有各自的时钟速率,该方法包括:

产生与所述第二电路的操作相关的状态信息;

基于所述状态信息确定是否需要调整所述第一时钟信号的时钟速率;

基于所述状态信息确定是否需要调整所述第二时钟信号的时钟速率;以及

如果需要调整,则调整所述第一时钟信号的时钟速率和所述第二时钟信号的时钟速率。

2.如权利要求1所述的方法,其中所述电子器件包括可操作以产生所述第一时钟信号和所述第二时钟信号的可调整时钟发生电路,并且其中基于所述状态信息调整所述第一时钟信号和所述第二时钟信号的时钟速率包括:

基于所述状态信息引导所述可调整时钟发生电路来调整所述第一时钟信号和所述第二时钟信号的时钟速率。

3.如权利要求2所述的方法,其进一步包括:

使用所述第一时钟信号产生输出信号;

在所述第二电路中接收所述输出信号;以及

生成所述状态信息,其中所述状态信息指示所述第二电路的当前处理能力。

4.如权利要求2所述的方法,其中所述可调整时钟发生电路可操作以生成多个固定速率时钟信号并且从所述多个固定速率时钟信号中选择所述第一时钟信号和所述第二时钟信号,并且其中基于所述状态信息引导所述可调整时钟发生电路来调整所述第一时钟信号的时钟速率包括:

控制所述多个固定速率时钟信号中的哪个固定速率时钟信号被所述可调整时钟发生电路选择为所述第一时钟信号。

5.如权利要求2所述的方法,其中所述第一时钟信号包括时钟脉冲,并且其中基于所述状态信息引导所述可调整时钟发生电路来调整所述第一时钟信号的时钟速率包括:

控制所述可调整时钟发生电路选择性地使能和选择性地禁能所述第一时钟信号的时钟脉冲。

6.如权利要求2所述的方法,其中基于所述状态信息引导所述可调整时钟发生电路来调整所述第一时钟信号的时钟速率包括:

控制所述可调整时钟发生电路来调整所述第一时钟信号和所述第二时钟信号的频率。

7.如权利要求1所述的方法,其中基于所述状态信息调整所述第一时钟信号和所述第二时钟信号的时钟速率包括:

基于所述状态信息以及所述第一时钟信号和所述第二时钟信号的时钟速率调整所述第一电路的时钟速率和所述第二电路的时钟速率。

8.一种电子器件,其包括:

基于时钟信号产生信号的电路;以及

控制电路,其接收状态信号并基于所述状态信号调整所述时钟信号。

9.如权利要求8所述的电子器件,其进一步包括:

可调整时钟信号发生电路,其可操作以产生所述时钟信号,其中所述控制电路可操作以通过向所述可调整时钟发生电路提供控制信号而调整所述时钟信号。

10.如权利要求9所述的电子器件,其中所述可调整时钟信号发生电路包括选自由以下电路构成的群组的时钟信号发生电路:可编程锁相环PLL电路和可编程延迟锁相环DLL电路。

11.如权利要求8所述的电子器件,其中所述可调整时钟信号发生电路包括:

时钟电路,其可操作以产生多个固定速率时钟信号;

多路复用器,其可操作以通过基于由所述控制电路提供的所述控制信号选择所述多个固定速率时钟信号中的一个时钟信号来生成时钟信号;以及

过滤电路,其可操作以从所述多路复用器接收所生成的时钟信号,其中所述过滤电路进一步可操作以从所生成的时钟信号中去除毛刺。

12.如权利要求9所述的电子器件,其中所述可调整时钟信号发生电路包括使能电路,所述使能电路可操作以基于由所述控制电路提供的所述控制信号选择性地禁能时钟信号。

13.如权利要求8所述的电子器件,其中所述电子器件包括具有被配置为形成所述电路的可编程逻辑区域的可编程集成电路。

14.一种电子器件,其包括:

可操作以基于时钟信号接收信号并处理所接收的信号的电路,其中所述电路可操作以产生指示所述电路的当前处理能力的状态信号。

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