[实用新型]一种高速延迟锁相环有效
| 申请号： | 201320680569.8 | 申请日： | 2013-10-30 |
| 公开（公告）号： | CN203563053U | 公开（公告）日： | 2014-04-23 |
| 发明（设计）人： | 亚历山大;刘成 | 申请（专利权）人： | 西安华芯半导体有限公司 |
| 主分类号： | H03L7/099 | 分类号： | H03L7/099;H03L7/085 |
| 代理公司： | 西安智邦专利商标代理有限公司 61211 | 代理人： | 张倩 |
| 地址： | 710055 陕西省西安*** | 国省代码： | 陕西;61 |
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| 摘要： | |||
| 搜索关键词： | 一种 高速 延迟 锁相环 | ||
【权利要求书】：
1.一种高速延迟锁相环，包括时钟组合电路、DLL逻辑控制电路以及DLL鉴相器，其特征在于：还包括分频器、第一DLL延迟链、第二DLL延迟链、第一反相器以及第二反相器，所述分频器的输入端接输入时钟，所述分频器的输出端与第一DLL延迟链连接，所述第一DLL延迟链与第二DLL延迟链之间通过第一反相器连接，所述第二DLL延迟链的输出端通过第二反相器同时与占空比校正电路DCC和时钟组合电路的输入端连接，所述DLL逻辑控制电路同时控制第一DLL延迟链和第二DLL延迟链，时钟组合电路输出的输出时钟和输入时钟均进入DLL鉴相器的输入端，所述DLL鉴相器的输出端与DLL逻辑控制电路连接。
2.根据权利要求1所述的高速延迟锁相环，其特征在于：所述分频器为二分分频器。
3.根据权利要求1或2所述的高速延迟锁相环，其特征在于：所述第一DLL延迟链和第二DLL延迟链完全相同。
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