[发明专利]一种基于PCIE数据传输的存储系统设计方法有效
申请号: | 201410246211.3 | 申请日: | 2014-06-05 |
公开(公告)号: | CN103984646B | 公开(公告)日: | 2018-01-02 |
发明(设计)人: | 刘涛;刘士豪 | 申请(专利权)人: | 浪潮电子信息产业股份有限公司 |
主分类号: | G06F12/08 | 分类号: | G06F12/08;G06F3/06 |
代理公司: | 济南信达专利事务所有限公司37100 | 代理人: | 姜明 |
地址: | 250101 山东*** | 国省代码: | 山东;37 |
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摘要: | |||
搜索关键词: | 一种 基于 pcie 数据传输 存储系统 设计 方法 | ||
1.一种基于PCIE数据传输的存储系统设计方法,其特征在于,该基于PCIE数据传输的存储系统设计方法,结合协议解码、协议转换关键电气因素,其主要内容包括:
①将每个服务器主板的CPU PCIE2.0接口引出,作为数据交换通道使用,每16个PCIE通道作为一组,16个传输通道的信号作为一个物理地址端口使用;
②将每一个物理地址端口对应的16个PCIE传输通道信号进行四路分支,并采用四个虚拟地址与分支对应,即每4个PCIE传输通道信号对应一个虚拟地址,形成虚拟PCIE地址通道;
③将虚拟PCIE地址通道连接至存储FLASH控制器的输入端,存储FLASH控制器接受PCIE的虚拟地址,并将地址保存,建立与虚拟通道对应的点对点传输路径;
④存储FLASH控制器将PCIE协议直接进行解码,并将数据直接分配存储到FLASH颗粒中;读取操作时,存储FLASH控制器将FLASH中的数据进行PCIE编码,并将数据直接放到虚拟PCIE地址通道中,进行整个PCIE链路的数据传输。
2.根据权利要求1所述的一种基于PCIE数据传输的存储系统设计方法,其特征在于,将每个服务器主板的CPU PCIE2.0接口引出,作为数据交换通道使用,在每个PCIE通道上增加隔直电容。
3.根据权利要求1所述的一种基于PCIE数据传输的存储系统设计方法,其特征在于,将每一个物理地址端口对应的16个PCIE传输通道信号进行四路分支,并采用四个虚拟地址与分支对应,即每4个PCIE传输通道信号作为一个虚拟通道,PCIE传输通道信号的分取方法为从小到大的顺序、依次计数的四个为一组。
4.根据权利要求3所述的一种基于PCIE数据传输的存储系统设计方法,其特征在于,采用高速FPGA芯片建立PCIE的虚拟通道被控制端,并采用四个虚拟地址寄存器与四个分支通道对应,即每4个PCIE传输通道信号对应一个虚拟地址,形成虚拟PCIE地址通道,CPU与PCIE的虚拟通道被控制端通过虚拟地址标示通讯。
5.根据权利要求4所述的一种基于PCIE数据传输的存储系统设计方法,其特征在于,采用Cyclone FPGA芯片建立存储FLASH控制器,将虚拟PCIE地址通道连接至存储FLASH控制器的输入端,存储FLASH控制器建立PCIE控制寄存器,需要对4个PCIE通道进行数据的处理;存储FLASH控制器收到PCIE的虚拟地址后,将虚拟地址保存在PCIE控制寄存器中,建立与虚拟通道被控制端相对应的点对点独立传输路径。
6.根据权利要求5所述的一种基于PCIE数据传输的存储系统设计方法,其特征在于,存储FLASH控制器将PCIE协议直接进行解码,将PCIE通道上的有效数据信息保存在程序堆栈中,根据先进后出的堆栈设置方法,将数据根据FLASH地址空间的顺序,直接分配存储到FLASH颗粒中;读取操作时,存储FLASH控制器将FLASH中的数据进行PCIE编码,同时进行数据的校验生成,并将数据及校验位直接放到虚拟PCIE地址通道中,进行整个PCIE链路的数据容错稳定传输。
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