[发明专利]一种肖特基二极管的制造方法在审
申请号: | 201410250761.2 | 申请日: | 2014-06-06 |
公开(公告)号: | CN105448710A | 公开(公告)日: | 2016-03-30 |
发明(设计)人: | 崔金洪;谢春诚 | 申请(专利权)人: | 北大方正集团有限公司;深圳方正微电子有限公司 |
主分类号: | H01L21/329 | 分类号: | H01L21/329 |
代理公司: | 北京银龙知识产权代理有限公司 11243 | 代理人: | 许静;黄灿 |
地址: | 100871 北京市海淀*** | 国省代码: | 北京;11 |
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摘要: | |||
搜索关键词: | 一种 肖特基 二极管 制造 方法 | ||
技术领域
本发明涉及半导体技术领域,特别是涉及一种肖特基二极管的制造方法。
背景技术
肖特基二极管(SBD)是近年发展起来的一种新型功率器件,具有大电流、低正向压降、高频低功耗、高浪涌电流、瞬态保护等特点,作为一种低压整流器件,广泛应用于各种低压高频开关电源,如稳压器、整流器、逆变器、UPS等,也可以作为快速钳位二极管使用。但是,现有技术中肖特基二极管的制造成本较高、流程步骤较多、生产效率较低。
发明内容
本发明要解决的技术问题是提供一种肖特基二极管的制造方法,解决现有技术中肖特基二极管制造成本较高、流程步骤较多、生产效率较低的问题。
为了解决上述技术问题,本发明实施例提供一种肖特基二极管的制造方法,包括如下步骤:
在硅片的第一表面制成二氧化硅层;
刻蚀所述二氧化硅层形成硬掩膜;
在所述二氧化硅层被刻蚀的部分进行光刻和刻蚀形成沟槽;
利用覆盖所述硬掩膜和所述沟槽中间部分的掩膜板,在所述沟槽中形成栅极氧化层;
在所述硬掩膜以及所述栅极氧化层的基础上制成多晶硅层;
移除所述第一表面上的所述硬掩膜以及所述沟槽外的多晶硅层;
沉积金属并合金,制成第一金属层;
对所述第一金属层进行光刻和刻蚀,形成第一电极;
在所述硅片与所述第一表面相对的第二表面上形成第二电极。
上述的制造方法,其中,制成所述二氧化硅层采用低压化学气相淀积设备,在680℃的温度下淀积7000埃的二氧化硅。
上述的制造方法,其中,刻蚀所述二氧化硅层采用干法刻蚀。
上述的制造方法,其中,刻蚀形成所述沟槽采用干法刻蚀,所述沟槽的深度为2.5um。
上述的制造方法,其中,形成所述栅极氧化层采用扩散炉在1000℃的温度下生长4000埃的二氧化硅。
上述的制造方法,其中,制成所述多晶硅层采用低压化学气相淀积设备,在560℃的温度下淀积8000埃的多晶硅。
上述的制造方法,其中,移除所述第一表面上的所述硬掩膜以及所述沟槽外的多晶硅层具体为:磨掉15500埃的厚度,包括8000埃的所述多晶硅层、7000埃的所述硬掩膜和500埃所述第一表面的硅。
上述的制造方法,其中,制成所述第一金属层具体为:
通过溅射台淀积1000埃的钛金属并在810℃的温度下进行30秒的合金,然后再通过所述溅射台溅射28000埃的铝生成所述第一金属层。
上述的制造方法,其中,形成所述第一电极具体为:对所述第一金属层进行光刻和刻蚀,并经过金属合金后采用扩散炉在425℃的温度下扩散60分钟形成所述第一电极。
上述的制造方法,其中,形成所述第二电极具体为:
将所述第二表面进行减薄至所述硅片减薄到325um,通过蒸发台在所述第二表面淀积1000埃的钛金属、3000埃的镍金属以及20000埃的银金属形成所述第二电极。
本发明的上述技术方案的有益效果如下:
上述方案中,所述制造方法极大的节约了制造成本和流程步骤,显著提高了肖特基二极管的生产效率。
附图说明
图1为本发明实施例的步骤示意图;
图2为本发明实施例的肖特基二极管制造过程中结构示意图一;
图3为本发明实施例的肖特基二极管制造过程中结构示意图二;
图4为本发明实施例的肖特基二极管制造过程中结构示意图三;
图5为本发明实施例的肖特基二极管制造过程中结构示意图四;
图6为本发明实施例的肖特基二极管制造过程中结构示意图五;
图7为本发明实施例的肖特基二极管制造过程中结构示意图六;
图8为本发明实施例的肖特基二极管制造过程中结构示意图七;
图9为本发明实施例的肖特基二极管制造过程中结构示意图八;
图10为本发明实施例的肖特基二极管制造过程中结构示意图九。
具体实施方式
为使本发明要解决的技术问题、技术方案和优点更加清楚,下面将结合附图及具体实施例进行详细描述。
本发明针对现有的技术中肖特基二极管制造成本较高、流程步骤较多、生产效率较低的问题,提供一种肖特基二极管的制造方法,如图1至图10所示,包括如下步骤:
步骤11:在硅片10的第一表面11制成二氧化硅层2;
步骤12:刻蚀所述二氧化硅层2形成硬掩膜3;
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