[发明专利]用于高速串行接收器电路的中央对准电路有效

专利信息
申请号: 201410302564.0 申请日: 2014-06-27
公开(公告)号: CN104252434B 公开(公告)日: 2017-06-16
发明(设计)人: G·W·巴克勒尔 申请(专利权)人: 阿尔特拉公司
主分类号: G06F13/38 分类号: G06F13/38;G06F13/40
代理公司: 北京纪凯知识产权代理有限公司11245 代理人: 赵蓉民
地址: 美国加*** 国省代码: 暂无信息
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摘要:
搜索关键词: 用于 高速 串行 接收器 电路 中央 对准
【权利要求书】:

1.一种用于操作串行接收器电路的方法,其包括:

经由多个串行通道接收串行数据;

通过控制所述多个串行通道的对准的对准电路来识别所述串行通道的当前次序;以及

通过所述对准电路基于所述当前次序来配置多级切换网络以按照期望次序布置所述串行通道。

2.根据权利要求1所述的方法,其进一步包括:

通过所述对准电路来识别为每个串行通道的所述串行数据中的字划定界限的成帧位。

3.根据权利要求2所述的方法,其进一步包括:

基于所述成帧位使每个串行通道的所述串行数据中的字对准。

4.根据权利要求1所述的方法,其进一步包括:

通过所述对准电路来识别所述串行通道之间的相对延迟;以及

使所述串行通道对准以减少所述相对延迟。

5.根据权利要求4所述的方法,其中配置所述多级切换网络进一步包括:

基于所述串行通道之间的所述相对延迟将所述串行通道的布置从所述当前次序切换到所述期望次序。

6.根据权利要求4所述的方法,其进一步包括:

监视所述串行通道的对准以检测所述串行通道之间的不对准,其中识别所述串行通道之间的所述相对延迟包括:

响应于检测到所述串行通道之间的不对准,识别所述串行通道之间的所述相对延迟。

7.根据权利要求1所述的方法,其进一步包括:

监视所述串行通道的次序;以及

响应于检测到所述串行通道的所监视次序与所述期望次序的偏离,配置所述多级切换网络以便基于所监视次序以所述期望次序重新布置所述串行通道。

8.根据权利要求1所述的方法,其中识别所述多个串行通道的所述当前次序进一步包括:

检查每个串行通道的所述串行数据中的通道位置标签标识符。

9.根据权利要求8所述的方法,其中识别所述多个串行通道的所述当前次序进一步包括:

将通道位置标签标识符保存到存储器。

10.根据权利要求1所述的方法,其中所述多级切换网络包含第一切换级、第二切换级和第三切换级,每个切换级具有相同数目的交叉开关。

11.一种用于配置多级切换网络的方法,所述多级切换网络具有输入端和输出端、包含耦合到所述输入端的输入开关块的输入级、包含耦合到所述输出端的输出开关块的输出级以及耦合在所述输入级与所述输出级之间的至少一个中间级,其中每个中间级包含至少一个中间开关块,所述方法包括:

通过耦合到所述多级切换网络的对应输入端的多个串行链路通道来接收多个串行数据流;

检查每个串行数据流以识别所述多级切换网络的对应期望输出;

针对每个串行链路通道,基于所述多级切换网络的所述对应输入端选择输入开关块;

针对每个串行链路通道,基于所述多级切换网络的所述对应期望输出端选择输出开关块;

针对每个串行链路通道,选择将所选定的输入开关块耦合到所选定的输出开关块的中间开关块;以及

确定所选定的中间开关块是否允许将所选定的输入开关块耦合到所选定的输出开关块。

12.根据权利要求11所述的方法,其中所述多级切换网络包括Clos网络。

13.根据权利要求11所述的方法,其中选择中间开关块进一步包括:

确定包含第一串行链路通道和后续串行链路通道的所述串行链路通道的处理次序;以及

针对处于所述处理次序的所述第一串行链路通道,选择将所选定的输入开关块耦合到所选定的输出开关块的中间开关块。

14.根据权利要求13所述的方法,其进一步包括:

响应于确定所选定的中间开关块允许将所选定的输入开关块耦合到所选定的输出开关块,将所选定的中间开关块记录为将所选定的输入开关块耦合到所选定的输出开关块;以及

针对处于所述处理次序的后续串行链路通道,选择将所选定的输入开关块耦合到所选定的输出开关块的中间开关块。

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