[发明专利]一种确定链路延时的方法、装置和通信设备有效

专利信息
申请号: 201410542155.8 申请日: 2014-10-14
公开(公告)号: CN105578585B 公开(公告)日: 2019-12-13
发明(设计)人: 杨丽宁;郝鹏;黄灿 申请(专利权)人: 深圳市中兴微电子技术有限公司
主分类号: H04W56/00 分类号: H04W56/00
代理公司: 11262 北京安信方达知识产权代理有限公司 代理人: 王素燕;龙洪
地址: 518085 广*** 国省代码: 广东;44
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摘要:
搜索关键词: 一种 确定 延时 方法 装置 通信 设备
【权利要求书】:

1.一种确定链路延时的方法,其特征在于,该方法包括:

依据预设的分频倍数对解析所得的每个数据通道的第一本地多帧时钟LMFC进行分频,得到对应每个数据通道的第二LMFC,并依据所述第二LMFC分别将所述每个数据通道中的数据写入相应缓存;

依据系统参考SYSREF信号和预设的LMFC间隔产生第三LMFC,并依据所述第三LMFC分别将每个数据通道中的数据从相应缓存中读出;

其中,所述第二LMFC的周期与所述第三LMFC的周期相同;

所述第一LMFC通过如下方式解析得到:

对已接收的每个数据通道的数据进行解析,依据所述每个数据通道的数据中已有的初始化通道对齐序列ILA信息,解析得到所述第一LMFC;

所述分频后得到的对应每个数据通道的第二LMFC的周期大于分频前所有数据通道中数据传输延时最大的数据通道对应的数据传输延时差。

2.根据权利要求1所述的方法,其特征在于,所述依据预设的分频倍数对解析所得的每个数据通道的第一LMFC进行分频,包括:

依据预先设置的分频倍数对所述解析得到的所述第一LMFC进行分频,得到第二LMFC。

3.根据权利要求1所述的方法,其特征在于,所述依据所述第二LMFC将所述每个数据通道中的数据写入缓存,包括:

对于每个数据通道,通过所述第二LMFC的第一个有效信号将所述缓存的数据写地址清零,之后将所述每个数据通道中的数据依次写入缓存中。

4.根据权利要求1所述的方法,其特征在于,所述每个数据通道中数据传输的延时差为:(N-1)*T_LMFC;

其中,所述N为预设的分频倍数,所述T_LMFC为一个标准的LMFC的长度。

5.根据权利要求1所述的方法,其特征在于,所述依据所述第三LMFC将每个数据通道中的数据从缓存中读出,包括:

对于每个数据通道,通过所述第三LMFC的第一个有效信号将所述缓存的读地址清零,之后将所述每个数据通道中的数据依次从缓存中读出。

6.一种确定链路延时的装置,其特征在于,该装置包括:分频与写入控制单元、缓存和读取控制单元;其中,

所述分频与写入控制单元,用于依据预设的分频倍数对解析所得的每个数据通道的第一LMFC进行分频,得到每个数据通道的第二LMFC,并依据所述第二LMFC分别将所述每个数据通道中的数据写入相应缓存;

所述读取控制单元,用于依据SYSREF信号和预设的LMFC间隔产生第三LMFC,并依据所述第三LMFC分别将每个数据通道中的数据从相应缓存中读出;

其中,所述第二LMFC的周期与所述第三LMFC的周期相同;

所述第一LMFC通过如下方式解析得到:

对已接收的每个数据通道的数据进行解析,依据所述每个数据通道的数据中已有的初始化通道对齐序列ILA信息,解析得到所述第一LMFC;

所述分频后得到的每个数据通道的第二LMFC的周期大于分频前所有数据通道中数据传输延时最大的数据通道对应的数据传输延时差。

7.根据权利要求6所述的装置,其特征在于,所述分频与写入控制单元包括:分频模块和写入模块;其中,

所述分频模块,用于依据预设的分频倍数对解析所得的每个数据通道的第一LMFC进行分频,得到对应每个数据通道的第二LMFC;

所述写入模块,用于依据所述分频模块产生的所述第二LMFC分别将所述每个数据通道中的数据写入相应缓存。

8.根据权利要求6所述的装置,其特征在于,所述读取控制单元包括:LMFC生成模块和读取模块;其中,

所述LMFC生成模块,用于依据SYSREF信号和预设的LMFC间隔产生第三LMFC;

所述读取模块,用于依据所述LMFC生成模块生成的所述第三LMFC分别将每个数据通道中的数据从相应缓存中读出。

9.一种确定链路延时的通信设备,其特征在于,所述通信设备包括权利要求6-8中任一项所述的装置。

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