[发明专利]一种或非门闪存存储器有效
申请号: | 201410854600.4 | 申请日: | 2014-12-31 |
公开(公告)号: | CN104576649A | 公开(公告)日: | 2015-04-29 |
发明(设计)人: | 冯骏;舒清明 | 申请(专利权)人: | 北京兆易创新科技股份有限公司 |
主分类号: | H01L27/115 | 分类号: | H01L27/115;H01L29/423 |
代理公司: | 北京品源专利代理有限公司 11332 | 代理人: | 胡彬;邓猛烈 |
地址: | 100083 北京市海淀*** | 国省代码: | 北京;11 |
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摘要: | |||
搜索关键词: | 一种 非门 闪存 存储器 | ||
1.一种或非门闪存存储器,其特征在于,包括:
基底,所述基底在第一方向上开有深隔离槽,在第二方向上开有浅隔离槽,所述深隔离槽的深度大于所述浅隔离槽的深度;
氧化层,所述氧化层位于所述深隔离槽内,将相邻的两个所述浅隔离槽分为一组,每相邻两组浅隔离槽之间的氧化层的高度高于每组浅隔离槽之间的氧化层的高度,且所述每组浅隔离槽之间的氧化层的高度高于所述浅隔离槽内的氧化层的高度;
沟道区,所述沟道区位于所述浅隔离槽内的基底上表面内;
隧穿氧化层,所述隧穿氧化层位于所述沟道区之上;
浮栅层,所述浮栅层位于所述隧穿氧化层之上,所述浮栅层的高度高于所述浅隔离槽内的氧化层的高度,且所述浮栅层的高度低于所述每组浅隔离槽之间的氧化层的高度;
层间介电质层,所述层间介电质层位于所述浮栅层和所述浅隔离槽内的氧化层之上以及所述浮栅层的侧壁;
控制栅层,所述控制栅层位于所述层间介电质层之上,所述控制栅层的高度低于所述每相邻两组浅隔离槽之间的氧化层的高度,且所述控制栅层的高度高于所述每组浅隔离槽之间的氧化层的高度;
薄膜层,所述薄膜层位于所述控制栅层和所述氧化层的侧壁;
合金层,所述合金层位于所述控制栅层之上;
氮化硅层,所述氮化硅层位于所述合金层之上,所述氮化硅层上表面与所述每相邻两组浅隔离槽之间的氧化层上表面平齐;
源极,所述源极位于所述每组浅隔离槽之间的基底上表面内;
漏极,所述漏极位于所述每相邻两组浅隔离槽之间的基底上表面内;
第一金属层,所述第一金属层覆盖所述源极和所述漏极;
第二金属层,所述第二金属层位于所述漏极之上的第一金属层之上;
隔离层,所述隔离层覆盖所述第一金属层、所述氧化层、所述氮化硅层和所述薄膜层,且所述隔离层上表面与所述第二金属层上表面平齐。
2.根据权利要求1所述的或非门闪存存储器,其特征在于,所述深隔离槽的侧面与底面的夹角为钝角,所述浅隔离槽的侧面与底面的夹角为直角。
3.根据权利要求1-2任一所述的或非门闪存存储器,其特征在于,所述基底为注入P型离子的硅衬底。
4.根据权利要求1-2任一所述的或非门闪存存储器,其特征在于,所述第二氧化层、所述隧穿氧化层、所述层间介电质层、所述薄膜层和所述隔离层的材料为氧化硅。
5.根据权利要求1-2任一所述的或非门闪存存储器,其特征在于,所述浮栅层和所述控制栅层的材料为多晶硅。
6.根据权利要求1-2任一所述的或非门闪存存储器,其特征在于,所述第一金属层和所述第二金属层的材料为钨。
7.根据权利要求1-2任一所述的或非门闪存存储器,其特征在于,所述沟道区是通过在基底上表面注入P型离子制备而成的,所述源极和所述漏极是通过在基底上表面注入N型离子制备而成的。
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L27-00 由在一个共用衬底内或其上形成的多个半导体或其他固态组件组成的器件
H01L27-01 .只包括有在一公共绝缘衬底上形成的无源薄膜或厚膜元件的器件
H01L27-02 .包括有专门适用于整流、振荡、放大或切换的半导体组件并且至少有一个电位跃变势垒或者表面势垒的;包括至少有一个跃变势垒或者表面势垒的无源集成电路单元的
H01L27-14 . 包括有对红外辐射、光、较短波长的电磁辐射或者微粒子辐射并且专门适用于把这样的辐射能转换为电能的,或适用于通过这样的辐射控制电能的半导体组件的
H01L27-15 .包括专门适用于光发射并且包括至少有一个电位跃变势垒或者表面势垒的半导体组件
H01L27-16 .包括含有或不含有不同材料结点的热电元件的;包括有热磁组件的