[实用新型]一种任意信号发生器有效
| 申请号： | 201420375955.0 | 申请日： | 2014-07-08 |
| 公开（公告）号： | CN204031098U | 公开（公告）日： | 2014-12-17 |
| 发明（设计）人： | 刘小强;李金新;汪洁 | 申请（专利权）人： | 杭州通飞科技有限公司 |
| 主分类号： | H03K3/02 | 分类号： | H03K3/02 |
| 代理公司： | 杭州杭诚专利事务所有限公司 33109 | 代理人： | 尉伟敏 |
| 地址： | 310018 浙江省杭州市杭州经*** | 国省代码： | 浙江;33 |
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| 摘要： | |||
| 搜索关键词： | 一种 任意 信号发生器 | ||
1.一种任意信号发生器，其特征是，包括锁相环(1)、EPCS控制器(2)、SDRAM控制器(3)、U盘及SD卡控制器(4)、触摸屏(5)、嵌入式处理器(6)、扰码发生器(7)、第一累加器(8)、第二累加器(9)、数据选择器(10)、单端口片上RAM存储器(11)和液晶显示屏(12)，所述的锁相环(1)、EPCS控制器(2)、SDRAM控制器(3)、U盘及SD卡控制器(4)、第一累加器(8)、触摸屏(5)、数据选择器(10)、单端口片上RAM存储器(11)和液晶显示屏(12)均与嵌入式处理器(6)连接，所述的第一累加器(8)连接第二累加器(9)，所述的第二累加器(9)连接扰码发生器(7)和数据选择器(10)，所述的数据选择器(10)连接单端口片上RAM存储器(11)。
2.根据权利要求1所述的一种任意信号发生器，其特征是，所述的锁相环(1)有四个端口，分别为片外时钟源输入端、片上系统时钟源输出端、SDRAM控制器时钟源输出端和U盘及SD卡控制器时钟源输出端，所述的片上系统时钟源输出端分别连接嵌入式处理器(6)、单端口片上RAM存储器(11)、扰码发生器(7)、第一累加器(8)和第二累加器(9)，所述的SDRAM控制器时钟源输出端连接SDRAM控制器(3)，所述的U盘及SD卡控制器时钟源输出端连接U盘及SD卡控制器(4)。
3.根据权利要求2所述的一种任意信号发生器，其特征是，所述的第一累加器(8)和第二累加器(9)均为32位加法器，所述的第一累加器(8)和第二累加器(9)均有四个端口，分别为片上系统时钟源输入端、第一输入端、第二输入端和输出端，所述第一累加器(8)和第二累加器(9)的片上系统时钟源输入端均连接锁相环(1)的片上系统时钟源输出端，所述第一累加器(8)的第一输入端连接嵌入式处理器(6)，所述第二累加器(9)的第一输入端连接第一累加器(8)的输出端，所述第一累加器(8)的第二输入端连接第一累加器(8)的输出端，所述第二累加器(9)的第二输入端连接扰码发生器(7)。
4.根据权利要求1或2或3所述的一种任意信号发生器，其特征是，还包括复位按钮(13)，所述的复位按钮(13)连接嵌入式处理器(6)。
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