[发明专利]用于高频时钟互连的具有输出摆幅检测器的电流模式缓冲器有效
申请号: | 201480014291.8 | 申请日: | 2014-03-11 |
公开(公告)号: | CN105191128B | 公开(公告)日: | 2018-06-12 |
发明(设计)人: | D·朴;L·刘;S·荣 | 申请(专利权)人: | 高通股份有限公司 |
主分类号: | H03K5/08 | 分类号: | H03K5/08;H03K6/02 |
代理公司: | 上海专利商标事务所有限公司 31100 | 代理人: | 袁逸 |
地址: | 美国加利*** | 国省代码: | 美国;US |
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摘要: | |||
搜索关键词: | 电导率 可变 电路 电压摆幅 共用节点 时钟驱动器 电流模式 耦合到 减小 缓冲器 检测器 高速电流模式 反馈电路 高频时钟 控制电路 漏极端子 偏置节点 输出摆幅 输出端子 输入端子 栅极端子 振荡信号 响应 互连 可选 | ||
1.一种电流模式时钟驱动器电路,包括:
第一PMOS晶体管,其具有接收振荡信号的栅极端子、和接收第一电源电压的源极端子;
第一NMOS晶体管,其具有接收所述振荡信号的栅极端子、和接收第二电源电压的源极端子;
第一可变电导率电路,其具有耦合到所述第一PMOS晶体管的漏极端子的第一输入端子、和耦合到共用节点的输出端子;
第二可变电导率电路,其具有耦合到所述第一NMOS晶体管的漏极端子的第一输入端子,所述第二可变电导率电路具有耦合到所述共用节点的输出端子;以及
控制电路,其适配成响应于所述共用节点的电压摆幅的减小而增大所述第一和第二可变电导率电路的电导率,所述控制电路进一步适配成响应于所述共用节点的电压摆幅的增加而减小所述第一和第二可变电导率电路的所述电导率,以及其中所述控制电路包括第一偏置电路,所述第一偏置电路包括:
第一电流镜;
第一电容器;以及
第一差分放大器,其包括第三NMOS晶体管,所述第三NMOS晶体管具有响应于所述共用节点的所述电压的源极端子。
2.如权利要求1所述的电流模式时钟驱动器电路,其特征在于,所述第一可变电导率电路是第二PMOS晶体管,所述第二PMOS晶体管具有耦合到所述第一PMOS晶体管的漏极端子的源极端子、以及耦合到所述共用节点的漏极端子。
3.如权利要求2所述的电流模式时钟驱动器电路,其特征在于,所述第二可变电导率电路是第二NMOS晶体管,所述第二NMOS晶体管具有耦合到所述第一NMOS晶体管的漏极端子的源极端子、以及耦合到所述共用节点的漏极端子。
4.如权利要求1所述的电流模式时钟驱动器电路,其特征在于,所述第一差分放大器进一步包括第四NMOS晶体管,所述第四NMOS晶体管接收由所述第一电流镜生成的电流,并且具有耦合到所述第三NMOS晶体管的栅极端子的栅极端子。
5.如权利要求4所述的电流模式时钟驱动器电路,其特征在于,进一步包括耦合在所述第四NMOS晶体管的源极端子与所述第二电源电压之间的电阻性元件。
6.如权利要求5所述的电流模式时钟驱动器电路,其特征在于,跨所述第一电容器的电压由所述第一电流镜所提供的电流与流过所述第三NMOS晶体管的电流之间的差来定义。
7.如权利要求6所述的电流模式时钟驱动器电路,其特征在于,所述控制电路进一步包括第二偏置电路,所述第二偏置电路包括:
第二电流镜;
第二电容器;以及
第二差分放大器,其包括第三PMOS晶体管,所述第三PMOS晶体管具有响应于所述共用节点的所述电压的源极端子。
8.如权利要求7所述的电流模式时钟驱动器电路,其特征在于,所述第二差分放大器进一步包括第四PMOS晶体管,所述第四PMOS晶体管接收所述第二电流镜所生成的电流,并且具有耦合到所述第三PMOS晶体管的栅极端子的栅极端子。
9.如权利要求8所述的电流模式时钟驱动器电路,其特征在于,跨所述第二电容器的电压由所述第二电流镜所提供的电流与流过所述第三PMOS晶体管的电流之间的差来定义。
10.如权利要求9所述的电流模式时钟驱动器,其特征在于,所述第二可变电导率电路是第二NMOS晶体管,跨所述第一电容器的电压被施加到所述第二NMOS晶体管的栅极端子。
11.如权利要求10所述的电流模式时钟驱动器,其特征在于,所述第一可变电导率电路是第二PMOS晶体管,跨所述第二电容器的电压被施加到所述第二PMOS晶体管的栅极端子。
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