[发明专利]一种移位寄存器单元及其驱动方法、栅极驱动电路、显示装置有效

专利信息
申请号: 201510082323.4 申请日: 2015-02-15
公开(公告)号: CN104575438B 公开(公告)日: 2017-05-03
发明(设计)人: 吕磊;徐飞 申请(专利权)人: 合肥京东方光电科技有限公司;京东方科技集团股份有限公司
主分类号: G09G3/36 分类号: G09G3/36;G11C19/28
代理公司: 北京中博世达专利商标代理有限公司11274 代理人: 申健
地址: 230012 安徽*** 国省代码: 安徽;34
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摘要:
搜索关键词: 一种 移位寄存器 单元 及其 驱动 方法 栅极 电路 显示装置
【说明书】:

技术领域

发明涉及显示技术领域,尤其涉及一种移位寄存器单元及其驱动方法、栅极驱动电路、显示装置。

背景技术

薄膜晶体管液晶显示屏(Thin Film Transistor Liquid Crystal Display,简称TFT-LCD)的驱动电路由栅极驱动电路和数据驱动电路组成。一般地,首先栅极驱动电路打开一行,数据驱动电路对此行像素进行充电,然后栅极驱动电路关闭此行并打开下一行,数据驱动电路再对打开的这一行像素进行充电,依次对每行像素充电以实现整面TFT-LCD的显示。

目前,一种现有的移位寄存器,电路结构如图1所示,该移位寄存器工作的第一阶段t1:输入信号端INPUT输入的信号为高电平,M1开启,节点PU处于高电平,对电容C进行充电,并且M3开启,时钟信号输入端CLK输入的信号为低电平,信号输出端处于低电平;第二阶段t2:输入信号端INPUT输入的信号为低电平,M1关闭,电容C对节点PU放电,节点PU保持高电平,M3保持开启,时钟信号输入端CLK输入的信号为高电平,信号输出端处于高电平;第三阶段t3:复位信号输入端RESET输入的信号为高电平,M2开启,节点PU处于低电平,M3、M6和M8关闭,M5和M7保持开启,节点PD为高电平,M4和M9开启,信号输出端处于低电平。

然而,如图2所示,信号输入端INPUT输入高电平信号时,电容C一端的PU点升高,导致电容C的另一端耦合噪声,从而导致信号输出端OUTPUT输出的信号存在噪声;并且,信号输出端OUTPUT通过M3与时钟信号输入端CLK连接,由于时钟信号输入端CLK的驱动能力较差,导致当负载较大时,信号输出端OUTPUT容易失真。

发明内容

本发明的目的在于提供一种移位寄存器单元及其驱动方法、栅极驱动电路、显示装置,用于解决信号输出端输出的信号存在噪声及易失真的问题。

为了实现上述目的,本发明提供如下技术方案:

第一方面,本发明提供一种移位寄存器单元,:输入模块、输出控制模块和输出模块;

所述输入模块包括第一输入子模块和第二输入子模块;其中,所述第一输入子模块连接信号输入端和第一节点,用于将所述信号输入端输入的信号传输至所述第一节点;所述第二输入子模块连接所述信号输入端、低电平信号输入端和第二节点,用于根据所述信号输入端输入的信号将所述低电平信号输入端输入的信号传输至所述第二节点;

所述输出控制模块连接所述第一节点、时钟信号输入端和所述第二节点,用于根据所述第一节点的信号将所述时钟信号输入端输入的信号传输至所述第二节点;

所述输出模块连接所述第二节点、高电平信号输入端和信号输出端,用于根据所述第二节点的信号将所述高电平信号输入端输入的信号传输至所述信号输出端。

结合第一方面,在第一方面的第一种实现方式中,还包括:复位控制模块、复位模块;

所述复位控制模块连接复位信号输入端、所述低电平信号输入端、所述第一节点、第三节点、所述高电平信号输入端和所述第二节点,用于根据所述复位信号输入端输入的信号将所述低电平信号输入端输入的信号传输至所述第一节点,并且将所述高电平信号输入端输入的信号传输至所述第三节点,并且根据所述第三节点的信号将所述低电平信号输入端输入的信号传输至所述第一节点和所述第二节点;

所述复位模块连接所述第三节点、所述低电平信号输入端和所述信号输出端,用于根据所述第三节点的信号将所述低电平信号输入端输入的信号传输至所述信号输出端。

结合第一方面,在第一方面的第二种实现方式中,所述第一输入子模块包括:第一晶体管,其栅极和第一级连接所述信号输入端,第二级连接所述第一节点。

所述第二输入子模块包括:第二晶体管,其栅极连接所述信号输入端,第一级连接所述第二节点,第二级连接所述低电平信号输入端。

结合第一方面,在第一方面的第三种实现方式中,所述输出控制模块包括:第三晶体管和电容;

所述第三晶体管,其栅极连接所述第一节点,第一级连接所述时钟信号输入端,第二级连接所述第二节点;

所述电容,其一端连接所述第一节点,另一端连接所述第二节点。

结合第一方面,在第一方面的第四种实现方式中,所述输出模块包括:第四晶体管;

所述第四晶体管,其栅极连接所述第二节点,第一级连接所述高电平信号输入端,第二级连接所述信号输出端。

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