[发明专利]一种高速数据采集系统中的SDRAM控制方法在审
| 申请号： | 201510103038.6 | 申请日： | 2015-03-10 |
| 公开（公告）号： | CN104658578A | 公开（公告）日： | 2015-05-27 |
| 发明（设计）人： | 魏爱香;林康保;招瑜;刘俊 | 申请（专利权）人： | 广东工业大学 |
| 主分类号： | G11C7/10 | 分类号： | G11C7/10;G11C11/4063 |
| 代理公司： | 广州市南锋专利事务所有限公司 44228 | 代理人： | 刘媖 |
| 地址： | 510090 广东*** | 国省代码： | 广东;44 |
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| 摘要： | |||
| 搜索关键词： | 一种 高速 数据 采集 系统 中的 sdram 控制 方法 | ||
【权利要求书】：
1.一种高速数据采集系统中的SDRAM控制方法，所述高速数据采集系统包括有SDRAM存储器、时钟模块和由FPGA芯片实现的控制器，其特征在于：所述控制器包括有主状态机和片上锁相环，所述SDRAM控制方法包括以下步骤：
A、利用片上锁相环将时钟模块的输入时钟倍频并移相，使控制器在时钟信号的上升沿对命令进行采样；
B、所述控制器向SDRAM发出预充电命令、刷新命令和模式寄存器装载命令；
C、所述主状态机对SDRAM进行读/写操作，其中SDRAM的写地址采用递增模式连续变化，SDRAM的读地址采用分段模式将一行的数据分段读出。
2.根据权利要求1所述的一种高速数据采集系统中的SDRAM控制方法，其特征在于：所述步骤C中SDRAM的读/写操作均采用突发长度为4的突发方式流水读/写。
3.根据权利要求1所述的一种高速数据采集系统中的SDRAM控制方法，其特征在于：所述主状态机的刷新方式采用自动刷新模块。
4.根据权利要求1所述的一种高速数据采集系统中的SDRAM控制方法，其特征在于：所述SDRAM读命令输入到数据输出延时为2个时钟周期。
5.根据权利要求1所述的一种高速数据采集系统中的SDRAM控制方法，其特征在于：所述SDRAM存储器和控制器采用相同的时钟信号。
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