[发明专利]显示面板及薄膜晶体管阵列基板有效

专利信息
申请号: 201510418529.X 申请日: 2015-07-16
公开(公告)号: CN105097838B 公开(公告)日: 2018-03-02
发明(设计)人: 赵莽;田勇;易士娟 申请(专利权)人: 武汉华星光电技术有限公司
主分类号: H01L27/12 分类号: H01L27/12;G02F1/1362
代理公司: 深圳翼盛智成知识产权事务所(普通合伙)44300 代理人: 黄威
地址: 430079 湖北省武汉市*** 国省代码: 湖北;42
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摘要:
搜索关键词: 显示 面板 薄膜晶体管 阵列
【说明书】:

【技术领域】

发明涉及显示技术领域,特别涉及一种显示面板及薄膜晶体管阵列基板。

【背景技术】

在传统的显示面板中,薄膜晶体管阵列基板的信号线层一般都是单一的金属层。

单一的金属层的抗ESD(Electro Static Discharge,静电放电)能力较差,并且,所述薄膜晶体管阵列基板中出现较大的静电时,单一的金属层很容易熔断,这会导致所述薄膜晶体管阵列基板中部分区域显示失效。

故,有必要提出一种新的技术方案,以解决上述技术问题。

【发明内容】

本发明的目的在于提供一种显示面板及薄膜晶体管阵列基板,其能防止因信号线断线而造成的显示不良问题。

为解决上述问题,本发明的技术方案如下:

一种显示面板,所述显示面板包括:一彩色滤光片基板;一液晶层;以及一薄膜晶体管阵列基板,所述薄膜晶体管阵列基板包括:一基板;一遮光金属层,所述遮光金属层设置在所述基板上;一第一绝缘层;一半导体层,所述半导体层设置在所述第一绝缘层上;一第二绝缘层,所述第二绝缘层设置在所述第一绝缘层和所述半导体层上;一第一信号线层,所述第一信号线层设置在所述第二绝缘层上;一第三绝缘层,所述第三绝缘层设置在所述第二绝缘层和所述第一信号线层上;一第二信号线层,所述第二信号线层设置在所述第三绝缘层上,并且所述第二信号线层通过第一通孔与所述半导体层连接;一第四绝缘层,所述第四绝缘层设置在所述第三绝缘层和所述第二信号线层上;一公共线层,所述公共线层设置在所述第四绝缘层上;一第三信号线层;一第五绝缘层,所述第五绝缘层设置在所述第三信号线层上;以及一像素电极层,所述像素电极层设置在所述第五绝缘层上;所述遮光金属层与所述第二信号线层通过连接构件连接;所述第二信号线层中的第二信号线包括:至少一第一分段;以及至少一第二分段;所述遮光金属层中的遮光线包括:至少一第三分段;以及至少一第四分段;所述连接构件包括:至少一第一子连接构件;以及至少一第二子连接构件;其中,所述第一分段和所述第三分段通过所述第一子连接构件连接,所述第二分段和所述第四分段通过所述第二子连接构件连接。

在上述显示面板中,所述连接构件设置于通孔内;所述通孔穿过所述第一绝缘层、所述第二绝缘层和所述第三绝缘层。

在上述显示面板中,所述连接构件的末端具有弯折部,所述弯折部与所述遮光金属层和/或所述第二信号线层接触。

一种薄膜晶体管阵列基板,所述薄膜晶体管阵列基板包括:一基板;一遮光金属层,所述遮光金属层设置在所述基板上;一第一绝缘层;一半导体层,所述半导体层设置在所述第一绝缘层上;一第二绝缘层,所述第二绝缘层设置在所述第一绝缘层和所述半导体层上;一第一信号线层,所述第一信号线层设置在所述第二绝缘层上;一第三绝缘层,所述第三绝缘层设置在所述第二绝缘层和所述第一信号线层上;一第二信号线层,所述第二信号线层设置在所述第三绝缘层上,并且所述第二信号线层通过第一通孔与所述半导体层连接;一第四绝缘层,所述第四绝缘层设置在所述第三绝缘层和所述第二信号线层上;一公共线层,所述公共线层设置在所述第四绝缘层上;一第三信号线层;一第五绝缘层,所述第五绝缘层设置在所述第三信号线层上;以及一像素电极层,所述像素电极层设置在所述第五绝缘层上;所述遮光金属层与所述第二信号线层通过连接构件连接;所述第二信号线层中的第二信号线包括:至少一第一分段;以及至少一第二分段;所述遮光金属层中的遮光线包括:至少一第三分段;以及至少一第四分段;所述连接构件包括:至少一第一子连接构件;以及至少一第二子连接构件;其中,所述第一分段和所述第三分段通过所述第一子连接构件连接,所述第二分段和所述第四分段通过所述第二子连接构件连接。

在上述薄膜晶体管阵列基板中,所述连接构件设置于通孔内;所述通孔穿过所述第一绝缘层、所述第二绝缘层和所述第三绝缘层。

在上述薄膜晶体管阵列基板中,所述连接构件的末端具有弯折部,所述弯折部与所述遮光金属层和/或所述第二信号线层接触。

相对现有技术,本发明有利于防止因信号线断线而造成的显示不良问题,能够有效地提升产品的良率。

为让本发明的上述内容能更明显易懂,下文特举优选实施例,并配合所附图式,作详细说明如下。

【附图说明】

图1为本发明的薄膜晶体管阵列基板的分区示意图;

图2为本发明的薄膜晶体管阵列基板的示意图;

图3为本发明的薄膜晶体管阵列基板中的外围区域的线路的示意图;

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