[发明专利]一种基于AMS的异步时序电路设计方法有效

专利信息
申请号: 201510477677.9 申请日: 2015-08-06
公开(公告)号: CN105046014B 公开(公告)日: 2018-03-20
发明(设计)人: 贺雅娟;万立;马斌;邢彦;甄少伟;罗萍;张波 申请(专利权)人: 电子科技大学
主分类号: G06F17/50 分类号: G06F17/50
代理公司: 成都点睛专利代理事务所(普通合伙)51232 代理人: 葛启函
地址: 611731 四川省成*** 国省代码: 四川;51
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摘要:
搜索关键词: 一种 基于 ams 异步 时序 电路设计 方法
【权利要求书】:

1.一种基于AMS的异步电路设计方法,其特征在于,包括以下步骤:

a.确定所设计的异步时序电路的整体架构;

b.根据异步时序电路的特点将其划分为控制通路和数据通路两部分;完成数据计算的主体为数据通路,数据通路占整体电路的绝大部分;另一部分控制数据的传输为控制通路,控制通路占整体电路很小部分;

c.以定制的方式完成替代全局时钟的控制通路设计,同时采用传统同步时序电路设计流程,以建立虚拟时钟的方式完成数据通路设计;

d.利用所搭建的AMS仿真平台,对控制通路和数据通路进行仿真、验证,得到形成整体电路的结构,具体方法为:

d1、搭建AMS仿真平台,结合数据通路和控制通路,进行仿真,得到仿真波形,并将仿真波形中数据通路部分转化为SAIF文件;

d2、数据通路通过同步电路综合工具进行综合,并导入SAIF文件对数据通路进行优化,最终得到数据通路门级网表;

d3、对数据通路门级网表进行仿真,验证功能正确并确定数据通路各级延迟;

d4、在AMS仿真平台上,结合数据通路和控制通路,完成控制通路延迟匹配,并通过仿真得到仿真波形,将仿真波形中数据通路部分转化为SAIF文件;

d5、将数据通路门级网表和SAIF导入综合工具,对数据通路进行优化,然后通过AMS平台进行控制通路延迟匹配;

d6、数据通路使用通用自动布局布线工具得到版图,验证DRC、LVS,并得到带寄生参数门级网表,控制通路使用定制版图,同样验证DRC、LVS,得到带寄生参数晶体管级网表;

d7、通过AMS仿真平台对整体电路进行后端验证;

d8、拼接数据通路和控制通路版图,验证整体版图DRC、LVS,完成整体电路设计。

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