[发明专利]一种双口RAM的访问方法及装置有效
| 申请号： | 201510901041.2 | 申请日： | 2015-12-05 |
| 公开（公告）号： | CN105573931B | 公开（公告）日： | 2019-10-15 |
| 发明（设计）人： | 张豪 | 申请（专利权）人： | 中国航空工业集团公司洛阳电光设备研究所 |
| 主分类号： | G06F13/16 | 分类号： | G06F13/16 |
| 代理公司： | 郑州睿信知识产权代理有限公司 41119 | 代理人： | 胡泳棋 |
| 地址： | 471009 *** | 国省代码： | 河南;41 |
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| 摘要： | |||
| 搜索关键词： | 一种 ram 访问 方法 装置 | ||
1.一种双口RAM的访问方法，其特征在于，包括如下步骤：
步骤1)：当双口RAM两侧的主处理器和协处理器在同一时间间隔内发出访问相同RAM地址的命令时，进行冲突监测；
步骤2)：冲突监测模块产生BUSYL或BUSYR信号，经过逻辑转换模块转换后，输出ACK_L或ACK_R应答信号给迟滞处理器，使迟滞处理器的总线周期延长；所述迟滞处理器是指在主处理器和协处理器中，在同一时间间隔访问双口RAM的时间上相对滞后的处理器；
所述步骤2)中利用BUSYL信号逻辑转换的设计方法为：逻辑转换模块内置计数器，设置迟滞处理器的总线访问信号为计数器启动信号；设置BUSYL信号为计数器清零信号，当计数器计数溢出时，使ACK_L信号有效，输出ACK_L应答信号；
或所述步骤2)中利用BUSYR信号逻辑转换的设计方法为：逻辑转换模块内置计数器，设置迟滞处理器的总线访问信号为计数器启动信号；设置BUSYR信号为计数器清零信号，当计数器计数溢出时，使ACK_R信号有效，输出ACK_R应答信号。
2.根据权利要求1所述一种双口RAM的访问方法，其特征在于，主处理器和协处理器没有在同一时间间隔内访问相同双口RAM时，BUSYR信号和BUSYL无效，两个处理器的总线周期不变，维持其默认值。
3.一种双口RAM的访问装置，其特征在于，包括如下模块：
模块1)：用于当双口RAM两侧的主处理器和协处理器在同一时间间隔内发出访问相同RAM地址的命令时，进行冲突监测；
模块2)：用于冲突监测模块产生BUSYL或BUSYR，经过逻辑转换模块转换后，输出ACK_L或ACK_R应答信号给迟滞处理器，使迟滞处理器的总线周期延长；所述迟滞处理器是指在主处理器和协处理器中，在同一时间间隔访问双口RAM的时间上相对滞后的处理器；
所述模块2)中利用BUSYL信号逻辑转换的设计方法为：逻辑转换模块内置计数器，设置迟滞处理器的总线访问信号为计数器启动信号；设置BUSYL信号为计数器清零信号，当计数器计数溢出时，ACK_L信号有效，输出ACK_L应答信号；
或所述模块2)中利用BUSYR信号逻辑转换的设计方法为：逻辑转换模块内置计数器，设置迟滞处理器的总线访问信号为计数器启动信号；设置BUSYR信号为计数器清零信号，当计数器计数溢出时，ACK_R信号有效，输出ACK_R应答信号。
4.根据权利要求3所述一种双口RAM的访问装置，其特征在于，主处理器和协处理器没有在同一时间间隔内访问相同双口RAM时，BUSYR信号和BUSYL无效，两个处理器的总线周期不变，维持其默认值。
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