[发明专利]一种1394总线多通道流数据并行拆包方法在审

专利信息
申请号: 201510932498.X 申请日: 2015-12-12
公开(公告)号: CN105550153A 公开(公告)日: 2016-05-04
发明(设计)人: 王宣明;田泽;蔡叶芳;郑新建 申请(专利权)人: 中国航空工业集团公司西安航空计算技术研究所
主分类号: G06F13/42 分类号: G06F13/42
代理公司: 西安智邦专利商标代理有限公司 61211 代理人: 王少文
地址: 710065 *** 国省代码: 陕西;61
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摘要:
搜索关键词: 一种 1394 总线 通道 数据 并行 方法
【权利要求书】:

1.一种1394总线多通道流数据并行拆包方法,其特征在于:包括以下步 骤:

步骤1:驱动层软件初始化时配置流数据发送配置表,按照发送目的通道号 分配每条流数据在每个发送周期内可发送的分包个数N,以及每个的消息ID号、 发送偏移时刻、发送缓冲区首地址信息;

步骤2:驱动层软件将待发送流数据按照发送目的通道号,存入分配的流数 据发送缓冲区,并将本条流数据需要拆分的分包总数通知硬件逻辑,启动本条 流数据发送;

步骤3:流数据源地址运算单元根据每条流数据M在一个发送周期内可发送 的分包(0、1、…、n、…、N),设计已发送周期个数计数器Strem_STOF_cntM[n], 所述已发送周期个数计数器初始值为“1”,每完成一次分包发送该计数器增“1”;

步骤4:流数据源地址运算单元根据“本条流数据发送缓冲区首地址+ Strem_STOF_cntM[n]*n*分包负载大小”的计算方法,获取该分包应携带的负载 位于主存中的位置,通知主机接口DMA控制接口从该位置取出对应负载信息, 并保存至硬件逻辑内部的对应数据发送缓冲区中(0、1、…、n、…、N);

步骤5:硬件逻辑从每个发送周期开始调度配置表,若在该条流数据M的某 个分包n的发送偏移时刻已将该分包n搬移至硬件逻辑内部的数据发送缓冲(n) 中,则硬件逻辑将该分包n数据封装并发送到1394总线上,完成本条流数据分 包n的发送,并将本条流数据M分包的发送个数计数器TX_Strem_split_cntM 增“1”,否则继续启动本条流数据M的分包(n+1)发送,在下个发送周期的分 包n的发送偏移时刻再启动该分包发送;

步骤6:判断本条流数据M分包的发送个数计数值与本条流数据需要拆分的 分包总数是否相等,不相等则返回步骤4,相等则转入步骤7;

步骤7:将已发送周期个数计数器Strem_STOF_cntM[n]复位为“1”,该条 流数据M发送完成标识置位,通知上层软件本条流数据发送完成。

2.根据权利要求1所述1394总线多通道流数据并行拆包方法,其特征在 于:所述步骤1中的配置表可配置不同发送目的通道号的流数据;所述不同发 送目的通道号的流数据按照步骤2至步骤7的方法并行处理。

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