[发明专利]用于制造半导体器件的构图方法、半导体器件制作方法有效
申请号: | 201510976847.8 | 申请日: | 2015-12-23 |
公开(公告)号: | CN106910677B | 公开(公告)日: | 2020-12-18 |
发明(设计)人: | 蒋运涛 | 申请(专利权)人: | 中芯国际集成电路制造(上海)有限公司;中芯国际集成电路制造(北京)有限公司 |
主分类号: | H01L21/027 | 分类号: | H01L21/027 |
代理公司: | 北京市磐华律师事务所 11336 | 代理人: | 董巍;高伟 |
地址: | 201203 *** | 国省代码: | 上海;31 |
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摘要: | |||
搜索关键词: | 用于 制造 半导体器件 构图 方法 制作方法 | ||
1.一种用于制造半导体器件的构图方法,其特征在于,包括下述步骤:
提供半导体衬底,在所述半导体上形成牺牲材料层;
在所述牺牲材料层上形成具有第一图案的光刻胶层;
以所述具有第一图案的光刻胶层为掩膜刻蚀所述牺牲材料层,以第一次图形化所述牺牲材料层,使所述牺牲材料层具有第一图案;
去除所述具有第一图案的光刻胶层,形成填充并覆盖所述具有第一图案的牺牲材料层的具有第二图案的光刻胶层;
以所述具有第二图案的光刻胶层为掩膜刻蚀所述具有第一图案的牺牲材料层,以使所述牺牲材料层具有第三图案;
形成填充并覆盖所述具有第三图案的牺牲材料层的掩膜材料层;
去除所述牺牲材料层,形成具有第四图案的掩膜层,
其中,所述第一图案和第二图案具有多个带状凹槽,且所述多个带状凹槽彼此交错但不重合,所述第三图案为所述第一图案的带状凹槽和第二图案带状凹槽交错形成的多个孤立凸起。
2.根据权利要求1所述的构图方法,其特征在于,每个所述凸起由所述第一图案和第二图案中各两个带状凹槽交错形成。
3.根据权利要求1或2所述的构图方法,其特征在于,所述第四图案为与所述第三图案对应的多个孔。
4.一种半导体器件的制造方法,所述方法包括:
提供半导体衬底,在所述半导体衬底上形成目标材料层;
使用如权利要求1~3中任一项所述的构图方法在所述目标材料层形成掩膜层;
以所述掩膜层为掩膜来执行后续工艺。
5.根据权利要求4所述的半导体器件的制造方法,其特征在于,在所述目标材料层上还形成有硬掩膜层、蚀刻停止层和界面层中的至少一种。
6.根据权利要求4所述的半导体器件的制造方法,其特征在于,所述后续工艺为蚀刻工艺。
该专利技术资料仅供研究查看技术是否侵权等信息,商用须获得专利权人授权。该专利全部权利属于中芯国际集成电路制造(上海)有限公司;中芯国际集成电路制造(北京)有限公司,未经中芯国际集成电路制造(上海)有限公司;中芯国际集成电路制造(北京)有限公司许可,擅自商用是侵权行为。如果您想购买此专利、获得商业授权和技术合作,请联系【客服】
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造