[发明专利]一种基于FPGA芯片的进位链工艺映射方法有效
申请号: | 201511018760.6 | 申请日: | 2015-12-29 |
公开(公告)号: | CN106934079B | 公开(公告)日: | 2020-04-07 |
发明(设计)人: | 耿嘉 | 申请(专利权)人: | 京微雅格(北京)科技有限公司 |
主分类号: | G06F30/30 | 分类号: | G06F30/30 |
代理公司: | 北京亿腾知识产权代理事务所(普通合伙) 11309 | 代理人: | 陈霁 |
地址: | 100176 北京市大兴区经济技术开发*** | 国省代码: | 北京;11 |
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摘要: | |||
搜索关键词: | 一种 基于 fpga 芯片 进位 工艺 映射 方法 | ||
1.一种基于FPGA芯片的进位链工艺映射方法,其特征在于,包括以下步骤:
获取全部算数运算宏模块;
依据各个算数运算宏模块的进位链占用量,对所述全部算数运算宏模块分别进行消耗值估算,以及根据每个算数运算宏模块的消耗值对所述全部算数运算宏模块进行排序;
计算FPGA芯片上可用的进位链余量;
估算消耗值最大的算数运算宏模块的进位链使用量;
将所述FPGA芯片上可用的进位链余量与所述消耗值最大的算数运算宏模块的进位链使用量进行比较,如果所述消耗值最大的算数运算宏模块的进位链使用量不大于所述FPGA芯片上可用的进位链余量,则所述消耗值最大的算数运算宏模块使用进位链的方式进行映射。
2.根据权利要求1所述的方法,其特征在于,如果所述消耗值最大的算数运算宏模块的进位链使用量大于所述FPGA芯片上可用的进位链余量,则所述消耗值最大的算数运算宏模块采用普通组合逻辑映射。
3.根据权利要求1所述的方法,其特征在于,在所述计算FPGA芯片上可用的进位链余量步骤之后,估算消耗值最大的算数运算宏模块的进位链使用量步骤之前还包括以下步骤:
对所述全部算数运算宏模块进行判断,如果所述全部算数运算宏模块都已经进行映射,则结束;如果还有未映射的算数运算宏模块,则估算未映射的运算宏模块中消耗值最大的算数运算宏模块的进位链使用量。
4.根据权利要求1所述的方法,其特征在于,所述计算FPGA芯片上可用的进位链余量步骤包括:
计算FPGA芯片实际的进位链数目,作为进位链余量。
5.根据权利要求1所述的方法,其特征在于,所述计算FPGA芯片上可用的进位链余量步骤包括:
计算FPGA芯片实际的进位链数目,取其一定比例作为进位链余量。
6.根据权利要求5所述的方法,其特征在于,将FPGA芯片实际的进位链数目的80%作为进位链余量。
7.根据权利要求1所述的方法,其特征在于,所述计算FPGA芯片上可用的进位链余量步骤包括:
计算FPGA芯片实际的进位链数目,指定其中的任一值作为进位链余量。
8.根据权利要求1所述的方法,其特征在于,所述算数运算宏模块包括加法运算宏模块、减法运算宏模块、比较运算宏模块和乘法运算宏模块中的一种或多种。
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