[发明专利]一种具有失调补偿的动态比较器

权利要求书

1.一种具有失调补偿的动态比较器，包括动态差分比较电路、基于逐次逼近逻辑的失调电压校正电路、时钟控制电路、第一开关SW11、第二开关SW12、第三开关SW13、第四开关SW14和第五开关SW15；

时钟控制电路的时钟输入端连接外部输入的时钟信号CLK；时钟控制电路的同相控制电位输出端输出同相控制电位信号CAL，时钟控制电路的反相控制电位输出端输出反相控制电位信号CAL；

基于逐次逼近逻辑的失调电压校正电路的时钟输入端连接外部输入的时钟信号CLK；基于逐次逼近逻辑的失调电压校正电路的控制电位输入端连接同相控制电位信号CAL；基于逐次逼近逻辑的失调电压校正电路的参考输入端连接参考电压Vb；基于逐次逼近逻辑的失调电压校正电路的同相输入端连接同相输出信号Von；基于逐次逼近逻辑的失调电压校正电路的反相输入端连接反相输出信号Vop；基于逐次逼近逻辑的失调电压校正电路的同相补偿输出端输出同相补偿信号Din；基于逐次逼近逻辑的失调电压校正电路的反相补偿输出端输出反相补偿信号Dip；

动态差分比较电路的时钟输入端连接外部输入的时钟信号CLK；动态差分比较电路的同相输入端同时连接第一开关SW11和第三开关SW13的其中一端，第一开关SW11的另一端连接外部输入的同相输入信号Vin，第三开关SW13的另一端连接外部输入的共模信号Vcm；动态差分比较电路的反相输入端同时连接第二开关SW12和第五开关SW15的其中一端，第二开关SW12的另一端连接外部输入的反相输入信号Vip，第五开关SW15的另一端连接外部输入的共模信号Vcm；第四开关SW14的一端连接动态差分比较电路的同相输入端，另一端连接动态差分比较电路的反相输入端；第一开关SW11和第二开关SW12的控制端连接反相控制电位信号CAL，第三开关SW13、第四开关SW14和第五开关SW15的控制端连接同相控制电位信号CAL；动态差分比较电路的同相补偿输入端连接同相补偿信号Din；动态差分比较电路的反相补偿输入端连接反相补偿信号Dip；动态差分比较电路的同相输出端输出同相输出信号Von；动态差分比较电路的反相输出端输出反相输出信号Vop；其特征是：

所述基于逐次逼近逻辑的失调电压校正电路包括第一晶体管M31、第二晶体管M32、第一电容C31、第六开关SW31、第七开关SW32、第八开关SW33、第一电流源Icp1、第二电流源Icp2、第一与门AND1、第二与门AND2和反相器NOT1；

第一晶体管M31的栅极形成基于逐次逼近逻辑的失调电压校正电路的参考输入端；第一晶体管M31的源极形成基于逐次逼近逻辑的失调电压校正电路的同相补偿输出端；第一晶体管M31的漏极接地；第二晶体管M32的源极形成基于逐次逼近逻辑的失调电压校正电路的反相补偿输出端；第二晶体管M32的漏极接地；第二晶体管M32的栅极连接第一电容C31的上极板、第六开关SW31的一端、第七开关SW32的一端和第八开关SW33的两端；第一电容C31的下极板接地；第六开关SW31的另一端连接第一电流源Icp1的一端，第一电流源Icp1的另一端接电源；第七开关SW32的另一端连接第二电流源Icp2的一端，第二电流源Icp2的另一端接地；

第六开关SW31的控制端连接第一与门AND1的输出端；第七开关SW32的控制端连接第二与门AND2输出端；第八开关SW33的控制端连接反相器NOT1的输出端；第一与门AND1的一个输入端和第二与门AND2的一个输入端共同形成基于逐次逼近逻辑的失调电压校正电路的控制电位输入端；第一与门AND1的另一个输入端形成基于逐次逼近逻辑的失调电压校正电路的同相输入端；第二与门AND2的另一个输入端形成基于逐次逼近逻辑的失调电压校正电路的反相输入端；反相器NOT1的输入端形成基于逐次逼近逻辑的失调电压校正电路的时钟输入端。

2.根据权利要求1所述的一种具有失调补偿的动态比较器，其特征是：动态差分比较电路包括动态比较器和锁存比较器；动态比较器的同相输入端和反相输入端分别形成动态差分比较电路的同相输入端和反相输入端；动态比较器的同相输出端和锁存比较器的同相输入端相连，并形成动态差分比较电路的同相补偿输入端；动态比较器的反相输出端和锁存比较器的反相输入端相连，并形成动态差分比较电路的反相补偿输入端；动态比较器的时钟输入端形成动态差分比较电路的时钟输入端；锁存比较器的同相输出端和反相输出端分别形成动态差分比较电路同相输出端和反相输出端。

3.根据权利要求1所述的一种具有失调补偿的动态比较器，其特征是：第六开关SW31的宽长比和第七开关SW32的宽长比相等，第八开关SW33的宽长比为第六开关SW31宽长比的二分之一。