[发明专利]半导体器件的形成方法有效
申请号: | 201610067392.2 | 申请日: | 2016-01-29 |
公开(公告)号: | CN105655341B | 公开(公告)日: | 2018-07-27 |
发明(设计)人: | 高超;江红;张永福;王哲献;李冰寒 | 申请(专利权)人: | 上海华虹宏力半导体制造有限公司 |
主分类号: | H01L27/11521 | 分类号: | H01L27/11521;H01L27/11531 |
代理公司: | 北京集佳知识产权代理有限公司 11227 | 代理人: | 高静;吴敏 |
地址: | 201203 上海市浦东*** | 国省代码: | 上海;31 |
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摘要: | |||
搜索关键词: | 半导体器件 形成 方法 | ||
1.一种半导体器件的形成方法,其特征在于,包括:
提供基底,所述基底包括存储区、逻辑区、以及位于存储区和逻辑区之间的隔离区,所述隔离区包括与存储区相邻接的第一隔离区、以及与逻辑区相邻接的第二隔离区,所述存储区基底表面形成有存储栅极膜、以及位于存储栅极膜表面的第一介质层,所述第一介质层还位于第一隔离区表面且暴露出第二隔离区表面;
形成覆盖所述第一介质层表面、第二隔离区表面、以及逻辑区基底表面的逻辑栅极膜;
在所述逻辑栅极膜表面形成第二介质层;
去除所述存储区以及隔离区的第二介质层,保留逻辑区的逻辑栅极膜表面的第二介质层;
去除所述存储区的逻辑栅极膜以及第一介质层顶部表面的逻辑栅极膜,保留第二隔离区的逻辑栅极膜;
去除所述第一介质层和第二介质层;
在所述第二隔离区的逻辑栅极膜顶部和侧壁表面、第一隔离区表面、存储栅极膜表面、以及部分逻辑区的逻辑栅极膜顶部表面形成图形化掩膜层;
以所述图形化掩膜层为掩膜,刻蚀逻辑区的逻辑栅极膜直至暴露出逻辑区基底表面,形成逻辑栅极结构,且在形成逻辑栅极结构后,第二隔离区剩余逻辑栅极膜为支撑栅结构,第二隔离区的图形化掩膜层覆盖支撑栅结构表面;
去除所述图形化掩膜层;
所述图形化掩膜层覆盖第二隔离区的部分逻辑栅极膜顶部时,在平行于存储区指向逻辑区的方向上,位于第二隔离区的逻辑栅极膜顶部的图形化掩膜层的宽度范围为大于最小特征尺寸。
2.如权利要求1所述的形成方法,其特征在于,所述图形化掩膜层覆盖第二隔离区的逻辑栅极膜部分或全部顶部;在形成所述逻辑栅极结构后,第二隔离区的部分或全部逻辑栅极膜为支撑栅结构。
3.如权利要求1所述的形成方法,其特征在于,所述逻辑区的第二介质层顶部低于存储区的第一介质层顶部;或者,所述逻辑区的第二介质层顶部与存储区的第一介质层顶部齐平。
4.如权利要求3所述的形成方法,其特征在于,去除所述存储区的逻辑栅极膜以及第一介质层顶部表面的逻辑栅极膜的方法包括:采用化学机械研磨工艺,研磨去除高于第一介质层顶部的逻辑栅极膜。
5.如权利要求1所述的形成方法,其特征在于,所述逻辑区的第二介质层顶部高于存储区的第一介质层顶部;去除所述存储区的逻辑栅极膜顶部表面和逻辑栅极膜的方法包括:采用化学机械研磨工艺,研磨去除高于第二介质层顶部的逻辑栅极膜;接着,采用回刻蚀工艺刻蚀去除高于第一介质层顶部的逻辑栅极膜。
6.如权利要求1所述的形成方法,其特征在于,在去除存储区的逻辑栅极膜以及第一介质层顶部表面的逻辑栅极膜的过程中,还去除第二隔离区的部分厚度的逻辑栅极膜。
7.如权利要求1所述的形成方法,其特征在于,采用湿法刻蚀工艺刻蚀去除所述图形化掩膜层。
8.如权利要求1所述的形成方法,其特征在于,所述图形化掩膜层的材料为氮化硅、氮氧化硅、碳氮氧化硅或氮化硼。
9.如权利要求1所述的形成方法,其特征在于,形成所述图形化掩膜层的工艺步骤包括:形成覆盖所述第二隔离区的逻辑栅极膜顶部和侧壁表面、第一隔离区表面、存储栅极膜表面、以及逻辑区的逻辑栅极膜顶部表面的初始硬掩膜层;在所述初始硬掩膜层表面形成第二图形层;以所述第二图形层为掩膜,刻蚀去除部分逻辑区的部分初始硬掩膜层,形成所述图形化掩膜层。
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L27-00 由在一个共用衬底内或其上形成的多个半导体或其他固态组件组成的器件
H01L27-01 .只包括有在一公共绝缘衬底上形成的无源薄膜或厚膜元件的器件
H01L27-02 .包括有专门适用于整流、振荡、放大或切换的半导体组件并且至少有一个电位跃变势垒或者表面势垒的;包括至少有一个跃变势垒或者表面势垒的无源集成电路单元的
H01L27-14 . 包括有对红外辐射、光、较短波长的电磁辐射或者微粒子辐射并且专门适用于把这样的辐射能转换为电能的,或适用于通过这样的辐射控制电能的半导体组件的
H01L27-15 .包括专门适用于光发射并且包括至少有一个电位跃变势垒或者表面势垒的半导体组件
H01L27-16 .包括含有或不含有不同材料结点的热电元件的;包括有热磁组件的