[发明专利]高速访问双倍速率同步动态随机存储器的控制方法及装置有效
申请号: | 201610162052.8 | 申请日: | 2016-03-18 |
公开(公告)号: | CN107204198B | 公开(公告)日: | 2020-06-09 |
发明(设计)人: | 岳雷霆 | 申请(专利权)人: | 深圳市中兴微电子技术有限公司 |
主分类号: | G11C7/10 | 分类号: | G11C7/10;G06F5/06 |
代理公司: | 北京天昊联合知识产权代理有限公司 11112 | 代理人: | 彭瑞欣;张天舒 |
地址: | 518085 广*** | 国省代码: | 广东;44 |
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摘要: | |||
搜索关键词: | 高速 访问 双倍 速率 同步 动态 随机 存储器 控制 方法 装置 | ||
1.一种高速访问双倍速率同步动态随机存储器的控制方法,其特征在于,所述方法包括:
将双倍速率同步动态随机存储器DDR按照动态配置策略划分为可变的缓存块;
基于所述可变的缓存块进行读写操作时,根据加权循环调度策略对针对多个通道的读/写操作进行调度,并对读/写带宽进行平衡;
所述方法还包括:
获取针对多个通道突发的读/写操作请求后,根据突发缓冲调度策略将对各个通道的读/写操作请求依次缓存下来,并记录缓存次序;
根据所述缓存次序,对所述DDR中的所述可变的缓存块进行本次读/写操作,在进行本次读/写操作对应的数据读写期间,支持针对所述各个通道其他读/写操作请求的调度。
2.根据权利要求1所述的方法,其特征在于,所述将DDR按照动态配置策略划分为可变的缓存块,包括:
将DDR的地址空间划分为数个区域,配置每个区域的起始地址和结束地址为均可配置;
配置所述每个区域由大小可配置的缓存块组成,每个缓存块均对应一个缓存指针BP;
对于写入DDR的数据包,根据所述数据包的包长选择缓存大小与其接近的区域,将其存入对应BP的缓存块里面。
3.根据权利要求2所述的方法,其特征在于,所述将DDR按照动态配置策略划分为可变的缓存块,还包括:
配置每个区域的BP为一个链表,将所述数据包写入所述DDR时,申请区域链表首部的BP,数据包读出DDR时,将BP写入链表的尾部;
根据BP大小选择执行一次写入或读出DDR数据的数据包大小,对于超过第一阈值的数据包包长,配置为一次写入或读出符合第二阈值的较长数据,并且保证一次写入或读出的地址是连续的。
4.根据权利要求1所述的方法,其特征在于,所述基于所述可变的缓存块进行读写操作时,根据加权循环调度策略对针对多个通道的读/写操作进行调度,并对读/写带宽进行平衡,包括:
为每一个读/写通道分配一个权重,每检测到发生了一次读/写操作,则将所述权重减去读出或写入的数据包的包长;
所述权重可调整,并按照定时器的设置定时增加所述权重。
5.根据权利要求4所述的方法,其特征在于,所述基于所述可变的缓存块进行读写操作时,根据加权循环调度策略对针对多个通道的读/写操作进行调度,并对读/写带宽进行平衡,还包括:
如果检测到针对多个通道的读/写操作,且申请数据长度均不大于通道当前权重,则选择读出或写入的数据包的包长与上次读/写操作相近的通道,以保证DDR地址连续;
6.根据权利要求4或5所述的方法,其特征在于,所述基于所述可变的缓存块进行读写操作时,根据加权循环调度策略对针对多个通道的读/写操作进行调度,并对读/写带宽进行平衡,还包括:
为写方向通道配置第一总权重;
为读方向通道配置第二总权重;
连续调度写方向通道的数据到权重为0、或者根据所述第一总权重检测到所有写方向通道的数据写入完成之后,连续调度读方向通道的数据到权重为0、或者直至根据所述第二总权重检测到所有读通道的数据读出完成,结束调度。
7.根据权利要求1所述的方法,其特征在于,根据突发缓冲调度策略将对各个通道的读/写操作请求依次缓存下来,并记录缓存次序,包括:
为读方向通道和写方向通道分别配置两个先进先出队列FIFO,两个FIFO中,第一FIFO用于缓存读写命令,第二FIFO用于缓存读写数据;
根据针对多个通道的读/写操作进行调度的调度结果依次将读写命令和通道标记缓存下来,将读写命令次序和通道标记次序作为所述缓存次序并存入所述第一FIFO中,按照所述读写命令次序将读写命令传递给所述DDR。
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