[发明专利]一种处理器以及处理器内置存储器的控制方法有效
| 申请号： | 201610846171.5 | 申请日： | 2016-09-23 |
| 公开（公告）号： | CN106897234B | 公开（公告）日： | 2019-07-30 |
| 发明（设计）人： | 王生洪 | 申请（专利权）人： | 常州新智源电子科技有限公司 |
| 主分类号： | G06F13/16 | 分类号： | G06F13/16;G06F1/03 |
| 代理公司： | 南京经纬专利商标代理有限公司 32200 | 代理人： | 姜慧勤 |
| 地址： | 213000 江苏省常州市武进高新技术产业开*** | 国省代码： | 江苏;32 |
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| 摘要： | |||
| 搜索关键词： | 一种 处理器 以及 内置 存储器 控制 方法 | ||
1.一种处理器内置存储器的控制方法，所述处理器设有内置存储器，且处理器还包括至少一个相位可移动的时钟驱动电路；所述内置存储器包括一个存储器群，存储器群包括至少一个存储器模块，各个存储器模块之间并行连接，存储器模块由相位可移动的时钟驱动电路驱动，且相位可移动的时钟驱动电路的频率低于处理器时钟频率；所述处理器还包括运算/控制单元，所述运算/控制单元与内置存储器之间连接有地址解码、存储器模块选择以及读写控制的逻辑电路，用于对存储器读写的数据流向进行控制；
其特征在于，该控制方法是当运算/控制单元向存储器模块发出读或写的信号时，同时，控制相位可移动的时钟驱动电路的相位进行移动，给存储器模块产生一个时钟脉冲，相位可移动的时钟驱动电路的相位移动的同时，驱动存储器模块接受运算/控制单元所发出的信号进行相应的操作，使存储器模块与运算/控制单元之间进行零等待周期的数据交换。
2.根据权利要求1所述处理器内置存储器的控制方法，其特征在于，所述相位可移动的时钟驱动电路采用PLL或者时钟选择电路实现。
3.根据权利要求1所述处理器内置存储器的控制方法，其特征在于，所述内置存储器用于处理器或专用芯片ASIC或片上系统SoC或者需要采用内置存储器的芯片。
4.根据权利要求1所述处理器内置存储器的控制方法，其特征在于，所述处理器对当前读写的存储器模块输送相应的时钟，并对当前未选中的存储器模块进行时钟停止操作控制。
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