[发明专利]半导体装置及其制造方法有效
申请号: | 201611046396.9 | 申请日: | 2016-11-23 |
公开(公告)号: | CN108091651B | 公开(公告)日: | 2021-03-30 |
发明(设计)人: | 周飞 | 申请(专利权)人: | 中芯国际集成电路制造(北京)有限公司;中芯国际集成电路制造(上海)有限公司 |
主分类号: | H01L27/04 | 分类号: | H01L27/04;H01L21/8234 |
代理公司: | 中国贸促会专利商标事务所有限公司 11038 | 代理人: | 张海强 |
地址: | 100176 北京市*** | 国省代码: | 北京;11 |
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摘要: | |||
搜索关键词: | 半导体 装置 及其 制造 方法 | ||
1.一种半导体装置的制造方法,其特征在于,包括:
提供衬底结构,所述衬底结构包括:具有第一器件区和第二器件区的衬底、在所述第一器件区上的第一伪栅结构、在所述第二器件区上的第二伪栅结构、以及在所述第一伪栅结构下方的漏极轻掺杂LDD区,所述第一器件区包括输入/输出I/O器件区,所述第二器件区包括内核器件区;所述第一伪栅结构包括在所述第一器件区上的第一伪栅电介质层、在所述第一伪栅电介质层上的第一伪栅、以及在所述第一伪栅的侧壁上的第一间隔物层;所述第二伪栅结构包括在所述第二器件区上的第二伪栅电介质层、在所述第二伪栅电介质层上的第二伪栅、以及在所述第二伪栅的侧壁上的第二间隔物层;
去除所述第一伪栅;
对所述第一间隔物层进行回刻,以减小所述第一间隔物层的厚度,所述回刻使得所述第一间隔物层的底部的厚度减小;
去除露出的第一伪栅电介质层,以形成第一沟槽;以及
去除所述第二伪栅和露出的第二伪栅电介质层,以形成第二沟槽。
2.根据权利要求1所述的方法,其特征在于,还包括:
沉积栅极电介质层,以覆盖所述第一沟槽的底部和侧壁以及所述第二沟槽的底部和侧壁;以及
在所述栅极电介质层上沉积栅极材料。
3.根据权利要求2所述的方法,其特征在于,在沉积栅极电介质层之前,还包括:
在所述第一沟槽的底部和所述第二沟槽的底部形成界面层。
4.根据权利要求2所述的方法,其特征在于,在沉积栅极电介质层之前,还包括:
在所述第一沟槽的底部形成栅极氧化物层。
5.根据权利要求1所述的方法,其特征在于,
所述第一器件区包括第一半导体区和在所述第一半导体区上的第一半导体鳍片;
所述第二器件区包括第二半导体区和在所述第二半导体区上的第二半导体鳍片;
其中,所述第一伪栅结构横跨在所述第一半导体鳍片上,所述第二伪栅结构横跨在所述第二半导体鳍片上。
6.根据权利要求5所述的方法,其特征在于,所述提供衬底结构的步骤包括:
提供初始衬底;
对所述初始衬底进行刻蚀,以形成所述第一器件区和所述第二器件区;
在各半导体鳍片之间形成隔离区,所述隔离区的顶表面低于各半导体鳍片的顶表面;
在各半导体鳍片位于所述隔离区以上的部分的表面上形成伪栅电介质层;
沉积伪栅材料并对所述伪栅材料进行图案化,从而形成所述第一伪栅和所述第二伪栅;
在所述第一伪栅的侧壁上形成所述第一间隔物层,并且在所述第二伪栅的侧壁上形成所述第二间隔物层;
以所述第一间隔物层为掩模进行LDD注入,以形成所述LDD区,从而形成第一结构;
在所述第一结构之上沉积层间电介质层;以及
对所述层间电介质层进行平坦化,以露出所述第一伪栅和所述第二伪栅。
7.根据权利要求6所述的方法,其特征在于,所述在所述第一结构之上沉积层间电介质层包括:
在所述第一结构上沉积接触蚀刻停止层;以及
在所述接触蚀刻停止层上沉积层间电介质层。
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L27-00 由在一个共用衬底内或其上形成的多个半导体或其他固态组件组成的器件
H01L27-01 .只包括有在一公共绝缘衬底上形成的无源薄膜或厚膜元件的器件
H01L27-02 .包括有专门适用于整流、振荡、放大或切换的半导体组件并且至少有一个电位跃变势垒或者表面势垒的;包括至少有一个跃变势垒或者表面势垒的无源集成电路单元的
H01L27-14 . 包括有对红外辐射、光、较短波长的电磁辐射或者微粒子辐射并且专门适用于把这样的辐射能转换为电能的,或适用于通过这样的辐射控制电能的半导体组件的
H01L27-15 .包括专门适用于光发射并且包括至少有一个电位跃变势垒或者表面势垒的半导体组件
H01L27-16 .包括含有或不含有不同材料结点的热电元件的;包括有热磁组件的