[发明专利]浅沟槽隔离浮栅结构的制作方法和浮栅型闪存的制作方法在审
申请号: | 201611191660.8 | 申请日: | 2016-12-21 |
公开(公告)号: | CN106783860A | 公开(公告)日: | 2017-05-31 |
发明(设计)人: | 姚兰;周俊 | 申请(专利权)人: | 武汉新芯集成电路制造有限公司 |
主分类号: | H01L27/115 | 分类号: | H01L27/115;H01L29/423 |
代理公司: | 上海思微知识产权代理事务所(普通合伙)31237 | 代理人: | 屈蘅,李时云 |
地址: | 430205 湖北*** | 国省代码: | 湖北;42 |
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摘要: | |||
搜索关键词: | 沟槽 隔离 结构 制作方法 浮栅型 闪存 | ||
1.一种浅沟槽隔离浮栅结构的制作方法,其特征在于,包括:
提供一半导体衬底;
在所述半导体衬底上依次形成一电子通道层和一电子存储层;
在所述电子存储层上形成图形化的光阻层;
以所述图形化的光阻层为掩膜,刻蚀所述电子存储层、电子通道层和部分半导体衬底,形成若干沟槽,再去除所述图形化光阻层;
在所述沟槽内填充绝缘材料,所述绝缘材料覆盖所述电子存储层;
采用化学机械研磨工艺去除所述电子存储层上的绝缘材料,形成浅沟槽隔离浮栅结构。
2.如权利要求1所述的浅沟槽隔离浮栅结构的制作方法,其特征在于,所述半导体衬底上形成有一外延层,所述电子通道层形成于所述外延层上。
3.如权利要求2所述的浅沟槽隔离浮栅结构的制作方法,其特征在于,所述外延层为P型掺杂外延层。
4.如权利要求2所述的浅沟槽隔离浮栅结构的制作方法,其特征在于,所述沟槽贯穿所述电子存储层、电子通道层和部分外延层。
5.如权利要求2所述的浅沟槽隔离浮栅结构的制作方法,其特征在于,所述半导体衬底中形成有一阱区。
6.如权利要求5所述的浅沟槽隔离浮栅结构的制作方法,其特征在于,所述阱区通过P型离子注入的方式形成。
7.如权利要求5所述的浅沟槽隔离浮栅结构的制作方法,其特征在于,一部分的沟槽贯穿所述电子存储层、电子通道层、阱区和部分外延层,另一部分沟槽贯穿所述电子存储层、电子通道层和部分外延层。
8.如权利要求1~7中任一项所述的浅沟槽隔离浮栅结构的制作方法,其特征在于,所述半导体衬底为P型掺杂衬底。
9.如权利要求1~7中任一项所述的浅沟槽隔离浮栅结构的制作方法,其特征在于,所述电子通道层的材质为氧化物。
10.如权利要求1~7中任一项所述的浅沟槽隔离浮栅结构的制作方法,其特征在于,所述电子存储层的材质为多晶硅。
11.如权利要求1~7中任一项所述的浅沟槽隔离浮栅结构的制作方法,其特征在于,所述绝缘材料通过高深宽比沉积工艺或者高密度电浆沉积工艺沉积。
12.一种浮栅型闪存的制作方法,其特征在于,包括:
采用如权利要求1~11中任一项所述的方法形成浅沟槽隔离浮栅结构。
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L27-00 由在一个共用衬底内或其上形成的多个半导体或其他固态组件组成的器件
H01L27-01 .只包括有在一公共绝缘衬底上形成的无源薄膜或厚膜元件的器件
H01L27-02 .包括有专门适用于整流、振荡、放大或切换的半导体组件并且至少有一个电位跃变势垒或者表面势垒的;包括至少有一个跃变势垒或者表面势垒的无源集成电路单元的
H01L27-14 . 包括有对红外辐射、光、较短波长的电磁辐射或者微粒子辐射并且专门适用于把这样的辐射能转换为电能的,或适用于通过这样的辐射控制电能的半导体组件的
H01L27-15 .包括专门适用于光发射并且包括至少有一个电位跃变势垒或者表面势垒的半导体组件
H01L27-16 .包括含有或不含有不同材料结点的热电元件的;包括有热磁组件的