[发明专利]一种应用于水下航行器的串行数据总线有效
申请号: | 201611270801.5 | 申请日: | 2016-12-27 |
公开(公告)号: | CN108241590B | 公开(公告)日: | 2021-05-18 |
发明(设计)人: | 李中庸;王明辉;刘庆 | 申请(专利权)人: | 中国船舶重工集团公司七五○试验场 |
主分类号: | G06F13/42 | 分类号: | G06F13/42 |
代理公司: | 暂无信息 | 代理人: | 暂无信息 |
地址: | 650001*** | 国省代码: | 云南;53 |
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摘要: | |||
搜索关键词: | 一种 应用于 水下 航行 串行 数据 总线 | ||
1.一种应用于水下航行器的串行数据总线,其特征在于:包括:第一类数据传输线,第二类数据传输线,第三类数据传输线;第一类数据传输线在传输数据时采用时分复用的方式;第二类数据传输线在传输数据时采用令牌轮询的方式;第三类数据传输线是CAN总线和以太网总线中的至少一种;
应用于水下航行器的串行数据总线的接入节点的接口电路包括:微处理器(1)、第一类数据传输线接口、第二类数据线接口、第三类数据线接口、跳线编码器(4)、用户节点接口(5);
第一类数据传输线接口包括RS485驱动模块以及时钟线;
第二类数据传输线接口包括RS485驱动模块;
第三类数据传输线接口是CAN总线驱动模块和以太网总线驱动模块中的至少一种;
在多个接入节点中,跳线编码器(4)设定的编码为“0”的节点通过时钟线输出同步时钟信号,并使用此同步时钟信号输出数据;
其它节点对于同步时钟信号进行延迟,然后使用延迟后的时钟信号输出数据,延迟对应于跳线编码器(4)设定的编码;
微处理器(1)包括同步控制模块、收发控制模块、数据接收模块和数据发送模块,用于完成总线上数据的收发时序控制、数据传输时序控制、与用户节点数据传输控制、驱动模块控制。
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