[发明专利]在跨存储器链路传送纠正数据时保护ECC位置有效
申请号: | 201680067395.4 | 申请日: | 2016-09-28 |
公开(公告)号: | CN108351820B | 公开(公告)日: | 2021-06-29 |
发明(设计)人: | D·I·韦斯特;J·徐 | 申请(专利权)人: | 高通股份有限公司 |
主分类号: | G06F11/10 | 分类号: | G06F11/10 |
代理公司: | 上海专利商标事务所有限公司 31100 | 代理人: | 陈炜;袁逸 |
地址: | 美国加利*** | 国省代码: | 暂无信息 |
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摘要: | |||
搜索关键词: | 存储器 传送 纠正 数据 保护 ecc 位置 | ||
1.一种低功率存储器子系统中的链路纠错和保护的方法,包括:
在掩码写操作期间将链路纠错码ECC奇偶校验位嵌入在未使用的数据掩码位和/或掩码写数据中;以及
通过在所述掩码写操作期间将所述未使用的数据掩码位或所述掩码写数据标识为所述链路纠错码ECC奇偶校验位的位置,在所述掩码写操作期间保护至少所述未使用的数据掩码位或所述掩码写数据中的所述链路纠错码ECC奇偶校验位的位置对抗链路错误。
2.如权利要求1所述的方法,其中,保护至少所述链路纠错码ECC奇偶校验位的位置包括:在所述掩码写操作期间传送数据掩码ECC奇偶校验位以保护至少第一经断言的数据掩码位,所述第一经断言的数据掩码位标识被嵌入在对应的掩码写数据字节中的所述链路纠错码ECC奇偶校验位。
3.如权利要求2所述的方法,进一步包括在所述掩码写操作期间传送所述链路纠错码ECC奇偶校验位在预定突发长度的写数据内的ECC位置码。
4.如权利要求3所述的方法,进一步包括在所述掩码写操作期间在命令/地址总线上传送所述数据掩码ECC奇偶校验位以及所述链路纠错码ECC奇偶校验位的所述ECC位置码。
5.如权利要求1所述的方法,其中,在所述掩码写操作期间嵌入包括:
确定预定突发长度的写数据是否包括第一经断言的数据掩码位;
将所述链路纠错码ECC奇偶校验位嵌入在与所述第一经断言的数据掩码位相对应的第一掩码写数据字节中并嵌入在所述第一经断言的数据掩码位内;以及
否则将所述链路纠错码ECC奇偶校验位嵌入在所述未使用的数据掩码位中。
6.如权利要求1所述的方法,其中,保护至少所述链路纠错码ECC奇偶校验位的位置包括:在所述掩码写操作期间传送指示所述链路纠错码ECC奇偶校验位在预定突发长度的写数据内的块位置的差拍位置码。
7.如权利要求6所述的方法,进一步包括传送指示所述链路纠错码ECC奇偶校验位是被嵌入在所述预定突发长度的写数据的数据部分还是所述数据掩码部分中的块位置码。
8.如权利要求7所述的方法,进一步包括在所述掩码写操作期间在命令/地址总线上传送所述差拍位置码和所述块位置码。
9.如权利要求1所述的方法,进一步包括接收用于读操作期间对读数据的捕捉的定时信息。
10.如权利要求1所述的方法,其中,进一步包括将所述低功率存储器子系统集成到移动电话、机顶盒、音乐播放器、视频播放器、娱乐单元、导航设备、计算机、手持式个人通信系统(PCS)单元、便携式数据单元、固定位置数据单元、服务器计算系统、和/或车辆控制系统中。
11.一种存储器子系统,包括:
具有纠错码(ECC)编码器/解码器逻辑的存储器控制器,所述存储器控制器被配置成在掩码写操作期间将链路纠错码ECC奇偶校验位嵌入在未使用的数据掩码位和/或掩码写数据中,并且被配置成通过在所述掩码写操作期间将所述未使用的数据掩码位或所述掩码写数据标识为所述链路纠错码ECC奇偶校验位的位置,在所述掩码写操作期间保护至少所述未使用的数据掩码位或所述掩码写数据中的所述链路纠错码ECC奇偶校验位的位置对抗链路错误。
12.如权利要求11所述的存储器子系统,其中,所述存储器控制器被进一步配置成:在所述掩码写操作期间传送数据掩码ECC奇偶校验位以保护至少第一经断言的数据掩码位并在所述掩码写操作期间传送所述链路纠错码ECC奇偶校验位在预定突发长度的写数据内的ECC位置码,所述第一经断言的数据掩码位标识被嵌入在对应的掩码写数据字节中的所述链路纠错码ECC奇偶校验位。
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