[发明专利]存在较慢扫描输出时实现较高扫描量的非隔行扫描操作有效
申请号: | 201710065794.3 | 申请日: | 2017-02-06 |
公开(公告)号: | CN107064784B | 公开(公告)日: | 2021-01-05 |
发明(设计)人: | M·S·卡沃萨;R·K·米塔尔 | 申请(专利权)人: | 德州仪器公司 |
主分类号: | G01R31/3185 | 分类号: | G01R31/3185 |
代理公司: | 北京律盟知识产权代理有限责任公司 11287 | 代理人: | 林斯凯 |
地址: | 美国德*** | 国省代码: | 暂无信息 |
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摘要: | |||
搜索关键词: | 存在 扫描 输出 实现 隔行 操作 | ||
1.一种测试集成逻辑电路的方法,所述方法包括:
通过集成电路的输入/输出缓冲器的所有引脚接收第一测试图案数据作为输入;
基于来自扫描时钟的第一时钟信号将所述第一测试图案数据从所述输入/输出缓冲器扫描到所述集成电路的扫描链中,所述第一时钟信号具有第一时钟速率;
将来自所述扫描链的所述第一测试图案数据作为第一刺激数据应用到所述集成电路的逻辑电路;
响应于所述第一刺激数据,通过所述扫描链捕获来自所述逻辑电路的第一响应数据;
基于来自所述扫描时钟的第二时钟信号将来自所述扫描链的所述第一响应数据扫描到所述输入/输出缓冲器,所述第二时钟信号具有第二时钟速率,其中所述输入/输出缓冲器作为输入缓冲器能够以与作为输出缓冲器相比更高的时钟速率操作,并且所述第二时钟速率比所述第一时钟速率慢;及
通过所述输入/输出缓冲器的所述所有引脚输出所述第一响应数据。
2.根据权利要求1所述的方法,其进一步包括,在输出来自所述扫描链的所述第一响应数据之后:
通过所述输入/输出缓冲器接收第二测试图案数据;及
以所述第一时钟速率将所述第二测试图案数据从所述输入/输出缓冲器扫描到所述扫描链中。
3.根据权利要求1所述的方法,其进一步包括,非重叠重复多次以下操作:
以所述第一时钟速率将所述第一测试图案数据扫描到所述扫描链中;及
以所述第二时钟速率将来自所述扫描链的所述第一响应数据扫描到所述输入/输出缓冲器中。
4.根据权利要求1所述的方法,其进一步包括:
以所述第一时钟速率将来自多个输入/输出缓冲器的所述第一测试图案数据扫描到多个扫描链中;
将来自所述多个扫描链的所述第一测试图案数据作为所述第一刺激数据应用到所述逻辑电路;
响应于所述第一刺激数据,通过所述多个扫描链捕获来自所述逻辑电路的第一响应数据;及
以所述第二时钟速率将来自所述多个扫描链的所述第一响应数据扫描到所述多个输入/输出缓冲器中。
5.根据权利要求1所述的方法,其进一步包括:
以所述第一时钟速率接收所述第一时钟信号;及
在接收所述第一时钟信号之后,以所述第二时钟速率接收所述第二时钟信号。
6.根据权利要求1所述的方法,其进一步包括:
通过所述扫描时钟以所述第一时钟速率将第一系列扫描时钟信号应用到所述扫描链;及
通过所述扫描时钟以所述第二时钟速率将第二系列扫描时钟信号应用到所述扫描链。
7.根据权利要求1所述的方法,其进一步包括:
响应于以所述第一时钟速率接收时钟信号,通过所述扫描时钟以所述第一时钟速率将第一系列扫描时钟信号应用到所述扫描链;及
响应于以所述第二时钟速率接收之后的时钟信号,通过所述扫描时钟以所述第二时钟速率将第二系列扫描时钟信号应用到所述扫描链。
8.根据权利要求1所述的方法,其中所述第一时钟速率是50MHz并且所述第二时钟速率是15MHz。
9.根据权利要求1所述的方法,其中所述输入/输出缓冲器耦合到四个输入/输出引脚。
10.根据权利要求1所述的方法,其进一步包括:
通过所述集成电路的状态机控制所述输入/输出缓冲器。
11.根据权利要求10所述的方法,其中响应于通过所述状态机检测外部引脚的断言边缘而执行控制所述输入/输出缓冲器。
12.根据权利要求10所述的方法,其进一步包括:
通过所述状态机监测测试图案数据流;及
其中响应于检测所述测试图案数据流中的指定测试图案而执行控制所述输入/输出缓冲器。
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