[发明专利]用于FINFET架构的用固态扩散源掺杂的隔离阱有效
申请号: | 201710102137.1 | 申请日: | 2013-09-25 |
公开(公告)号: | CN106887411B | 公开(公告)日: | 2020-12-22 |
发明(设计)人: | W·M·哈菲兹;C-H·简;J-Y·D·叶;张旭佑;N·迪亚斯;C·穆纳辛哈 | 申请(专利权)人: | 英特尔公司 |
主分类号: | H01L21/8238 | 分类号: | H01L21/8238;H01L27/092;H01L29/78;H01L21/336 |
代理公司: | 永新专利商标代理有限公司 72002 | 代理人: | 陈松涛;王英 |
地址: | 美国加*** | 国省代码: | 暂无信息 |
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摘要: | |||
搜索关键词: | 用于 finfet 架构 固态 扩散 掺杂 隔离 | ||
1.一种集成微电子结构,包括:
鳍状物,所述鳍状物包括硅并且包括位于第二区域之上的第一区域;
栅极叠置体,所述栅极叠置体与所述第一区域的侧壁表面相邻,其中,所述栅极叠置体包括栅极电介质和栅极电极;
源极和漏极;
电介质层,所述电介质层与所述第二区域的侧壁表面相邻,其中,所述电介质层包括杂质,所述杂质还存在于所述第二区域内并且与导电类型相关联;以及
隔离材料,所述隔离材料与所述电介质层相邻,
所述集成微电子结构还包括第二鳍状物,其中:
所述第二鳍状物包括上层区域和下层区域;
第二栅极叠置体与所述上层区域的侧壁表面相邻;并且
第二源极和第二漏极耦合到所述上层区域;
第二电介质层与所述下层区域的侧壁表面相邻,其中,所述第二电介质层包括第二杂质,所述第二杂质还存在于所述下层区域内并且与第二互补导电类型相关联;并且
所述隔离材料将所述电介质层与所述第二电介质层分隔开,
其中:所述电介质层和所述第二电介质层形成了与所述鳍状物的所述第二区域或所述第二鳍状物的下层区域中的至少一个区域的侧壁表面相邻的层的叠置体。
2.根据权利要求1所述的集成微电子结构,其中:
所述电介质层包括磷掺杂的硅酸盐玻璃(PSG);
所述杂质是磷;并且
所述鳍状物与PMOS晶体管相关联。
3.根据权利要求1所述的集成微电子结构,其中,所述电介质层与所述栅极电极或栅极电介质的至少其中之一接触。
4.根据权利要求1所述的集成微电子结构,其中:
所述第一区域具有小于20nm的横向宽度;
所述鳍状物具有介于20nm与150nm之间的垂直高度;并且
所述电介质层具有如正交于所述侧壁表面所测量到的介于1nm与5nm之间的厚度。
5.根据权利要求1所述的集成微电子结构,其中,所述电介质层具有大体上共形的厚度。
6.根据权利要求1所述的集成微电子结构,其中,所述隔离材料包括多个电介质层,所述多个电介质层包括氮化硅层,所述氮化硅层与所述电介质层和所述第二电介质层相邻。
7.根据权利要求1所述的集成微电子结构,其中:
所述电介质层包括磷掺杂的硅酸盐玻璃(PSG);
所述鳍状物与PMOS晶体管相关联;
所述第二电介质层包括硼掺杂的硅酸盐玻璃(BSG);并且
所述第二鳍状物与NMOS晶体管相关联。
8.根据权利要求1所述的集成微电子结构,其中,所述层的叠置体还包括位于所述电介质层与所述第二电介质层之间的氮化硅层。
9.根据权利要求1所述的集成微电子结构,其中,所述第二区域包括浓度在10e17cm-3与10e19cm-3之间的所述杂质。
10.根据权利要求9所述的集成微电子结构,其中,所述下层区域包括浓度在10e17cm-3与10e19cm-3之间的所述第二杂质。
11.根据权利要求1所述的集成微电子结构,其中,包括所述杂质的所述电介质层在与第二区域的所述侧壁表面相交的衬底表面之上延伸,位于所述衬底表面之上的所述电介质层将所述隔离材料与所述衬底表面分隔开。
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造