[发明专利]基于三维可写存储器的可编程门阵列在审
| 申请号： | 201710122749.7 | 申请日： | 2017-03-03 |
| 公开（公告）号： | CN108540126A | 公开（公告）日： | 2018-09-14 |
| 发明（设计）人： | 张国飙 | 申请（专利权）人： | 成都海存艾匹科技有限公司 |
| 主分类号： | H03K19/173 | 分类号： | H03K19/173 |
| 代理公司： | 暂无信息 | 代理人： | 暂无信息 |
| 地址： | 610041 四*** | 国省代码： | 四川;51 |
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| 摘要： | |||
| 搜索关键词： | 复杂计算 计算单元 可编程 可编程门阵列 可写存储器 三维 逻辑编程 用户需要 阵列存储 查找表 门阵列 存储 查找 | ||
1.一种可编程门阵列，其特征在于含有多个可编程计算单元，包括：
第一可编程计算单元，该第一可编程计算单元含有至少第一三维可写存储器（3D-W）阵列，该第一3D-W阵列存储第一函数的查找表（LUT）；
第二可编程计算单元，该第二可编程计算单元含有至少第二3D-W阵列，该第二3D-W阵列存储第二函数的LUT；
该第一和该第二函数为不同函数。
2.根据权利要求1所述的可编程门阵列，其特征还在于含有：
多个可编程逻辑单元，每个可编程逻辑单元可选择性地实现不同逻辑和/或算术功能；
第一可编程连接，至少部分所述可编程计算单元通过该第二可编程连接与至少部分所述可编程逻辑单元选择性地电耦合。
3.根据权利要求2所述的可编程门阵列，其特征还在于含有：
多个输入；
第二可编程连接，至少部分所述输入通过该第三可编程连接与至少部分所述可编程计算单元和/或至少部分所述可编程逻辑单元选择性地电耦合。
4.根据权利要求2所述的可编程门阵列，其特征还在于含有：
多个输出；
第三可编程连接，至少部分所述输出通过该第四可编程连接与至少部分所述可编程计算单元和/或至少部分所述可编程逻辑单元选择性地电耦合。
5.根据权利要求1所述的可编程门阵列，其特征还在于：所述第一和第二3D-W阵列为三维一次编程存储器（3D-OTP）。
6.根据权利要求1所述的可编程门阵列，其特征还在于：所述第一和第二3D-W阵列为三维多次编程存储器（3D-MTP）。
7.根据权利要求2所述的可编程门阵列，其特征还在于：所述3D-W阵列堆叠在该可编程逻辑电路上方。
8.根据权利要求7所述的可编程门阵列，其特征还在于：所述3D-W阵列覆盖至少部分该可编程逻辑电路。
9.根据权利要求1所述的可编程门阵列，其特征还在于：该第二3D-W阵列堆叠在该第一3D-W阵列上方。
10.根据权利要求9所述的可编程门阵列，其特征还在于：该第二3D-W阵列覆盖该第一3D-W阵列。
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