[发明专利]时钟校正装置及时钟校正方法有效
申请号: | 201710148735.2 | 申请日: | 2017-03-14 |
公开(公告)号: | CN107231150B | 公开(公告)日: | 2023-07-04 |
发明(设计)人: | 安达信吾 | 申请(专利权)人: | 株式会社巨晶片 |
主分类号: | H03L7/08 | 分类号: | H03L7/08 |
代理公司: | 北京铭硕知识产权代理有限公司 11286 | 代理人: | 金玉兰;王颖 |
地址: | 日本大阪*** | 国省代码: | 暂无信息 |
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摘要: | |||
搜索关键词: | 时钟 校正 装置 方法 | ||
1.一种时钟校正装置,其特征在于,具备:
校正电路,其在第一模式中基于偏斜调整信号,利用模拟控制进行输入时钟的偏斜调整,并且在第二模式中接收占空比控制信号,利用数字控制来进行所述输入时钟的占空比校正,所述偏斜调整信号基于输出时钟与参考时钟之间的相位差而得到;
偏斜检测电路,其接收所述输出时钟和所述参考时钟,并在仅所述参考时钟处于预定的状态时,输出成为所述预定的状态的检测信号;
积分电路,其在所述第一模式中对所述检测信号进行积分而生成第一电压信号,并在所述第二模式中对所述输出时钟进行积分而生成第二电压信号;以及
比较器,其在所述第一模式中通过对所述第一电压信号和第一参考信号进行比较来生成所述偏斜调整信号,并在所述第二模式中对所述第二电压信号和第二参考信号进行比较并生成校正完成信号。
2.根据权利要求1所述的时钟校正装置,其特征在于,
还具备封装电路,
基于来自所述封装电路的指示来选择所述第一模式和所述第二模式中的一个,
所述封装电路改变所述占空比控制信号的值,直至所述校正完成信号达到预定值为止。
3.一种时钟校正装置,为进行彼此具有预定的相位差的多相时钟的偏斜调整和占空比校正的多相时钟校正装置,其特征在于,具备:
多级连接的多个校正电路,所述校正电路在第一模式中基于偏斜调整信号,利用模拟控制来进行输入时钟的偏斜调整,并且在第二模式中接收占空比控制信号,利用数字控制来进行所述输入时钟的占空比校正,所述偏斜调整信号基于输出时钟与参考时钟之间的相位差而得到;
偏斜检测电路,其接收所述多个校正电路中的一个校正电路的所述输出时钟、以及作为所述参考时钟的所述一个校正电路的前级的所述校正电路的所述输出时钟,并在仅所述参考时钟处于预定的状态时,输出成为所述预定的状态的检测信号;
积分电路,其在所述第一模式中对所述检测信号进行积分而生成第一电压信号,并在所述第二模式中对所述多个校正电路中的预定的级的校正电路的所述输出时钟进行积分而生成第二电压信号;以及
比较器,其在所述第一模式中通过对所述第一电压信号和第一参考信号进行比较来生成所述一个校正电路的所述偏斜调整信号,并在所述第二模式中对所述第二电压信号和第二参考信号进行比较并生成所述预定的级的校正电路的校正完成信号。
4.根据权利要求3所述的时钟校正装置,其特征在于,
还具备封装电路,
基于来自所述封装电路的指示来选择所述第一模式和所述第二模式中的一个,
所述封装电路改变所述预定的级的校正电路的所述占空比控制信号的值,直至所述预定的级的校正电路的所述校正完成信号达到预定值为止。
5.一种时钟校正方法,为包含多级连接的多个校正电路的多相时钟校正装置中的多相时钟的时钟校正方法,其特征在于,包括:
在第一模式中基于偏斜调整信号,利用模拟控制来进行输入时钟的偏斜调整的步骤,所述偏斜调整信号基于输出时钟与参考时钟之间的相位差而得到;以及
在第二模式中接收占空比控制信号,利用数字控制来进行所述输入时钟的占空比校正的步骤,
所述偏斜调整的步骤还包括:
接收所述多个校正电路中的一个校正电路的所述输出时钟、以及成为所述参考时钟的所述一个校正电路的前级的所述校正电路的所述输出时钟,并在仅所述参考时钟处于预定的状态时,输出成为所述预定的状态的检测信号的步骤;
对所述检测信号进行积分而生成第一电压信号的步骤;以及
比较所述第一电压信号和第一参考信号并生成所述一个校正电路的所述偏斜调整信号的步骤,
所述占空比校正的步骤还包括:
对所述多个校正电路中的预定的级的校正电路的所述输出时钟进行积分而生成第二电压信号的步骤;以及
对所述第二电压信号和第二参考信号进行比较并生成所述预定的级的校正电路的校正完成信号的步骤。
6.根据权利要求5所述的时钟校正方法,其特征在于,
所述占空比校正的步骤还包括:
改变所述预定的级的校正电路的所述占空比控制信号的值,直至所述预定的级的校正电路的所述校正完成信号达到预定值为止的步骤。
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