[发明专利]一种印制电路板的制备方法及装置在审
申请号: | 201710516407.3 | 申请日: | 2017-06-29 |
公开(公告)号: | CN107148153A | 公开(公告)日: | 2017-09-08 |
发明(设计)人: | 邱家乐;黄德业;关志峰;李超谋;任代学 | 申请(专利权)人: | 珠海杰赛科技有限公司;广州杰赛电子有限公司 |
主分类号: | H05K3/06 | 分类号: | H05K3/06;H05K3/18 |
代理公司: | 广州三环专利商标代理有限公司44202 | 代理人: | 温旭 |
地址: | 519000 广东省珠海*** | 国省代码: | 广东;44 |
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摘要: | |||
搜索关键词: | 一种 印制 电路板 制备 方法 装置 | ||
技术领域
本申请涉及印制电路板制造领域,尤其涉及一种印制电路板的制备方法及装置。
背景技术
随着科学技术的发展,对于印制电路板(英文:Printed Circuit Board,简称:PCB)产品有着性能更高,以及更多样性的要求,PCB产品也越来越多样、复杂化,加工方法也不断优化和创新。为了实现在较厚铜导体中传输信号,在较薄铜导体中进行滤波此类特殊性能需求,同网络线路中会设计成差异铜厚线路即:阶梯线路。
此类铜厚产品现在两种做法:
(1)常规正片制作法,需要在铜面镀一层抗蚀金属保护,再在抗蚀金属表面镀铜,然后将局部铜层加厚,最后整体蚀刻基铜以达到阶梯线路,此方法会在两次铜层之间包含一层抗蚀金属,铜层与铜层之间会被隔开而影响信号的传输。
(2)常规负片制作法,不同厚度铜层在同时制作图形时,在不同铜厚阶梯交界处的抗蚀膜会存在贴膜不牢或者阶梯处空洞气泡问题,蚀刻时蚀刻液可能侵入导致线路受损开路,降低成品率。
发明内容
本发明实施例提供了一种印制电路板的制备方法及装置,用以解决现有技术中在两次铜层之间包含一层抗蚀金属,铜层与铜层之间会被隔开而影响信号的传输的问题。
其具体的技术方案如下:
一种印制电路板的制备方法,所述方法包括:
对印制电路板进行第一次外光成像处理,在所述印制电路板上显影出厚铜区域以及薄铜区域的所有线路;
对第一次外光成像处理的印制电路板进行蚀刻处理,去除显影出的线路上的基铜;
对蚀刻处理后的印制电路板进行第二次外光成像处理,在所述印制电路板上显影出厚铜区域;
对显影厚铜区域的印制电路板进行镀铜处理,以使厚铜区域镀上铜层;
去除所述印制电路板上的干膜,并且印制电路板上的线路两端的引线。
可选的,在对印制电路板进行第一次外光成像处理之后,所述方法还包括:
在所述印制电路板上的线路两端分别连接引线。
可选的,对显影厚铜区域的印制电路板进行镀铜处理,包括:
导通所述线路两端的引线的电流,并对显影厚铜区域的印制电路板。
可选的,所述干膜具体为抗蚀刻膜。
一种印制电路板的制备装置,所述装置包括:
处理模块,用于对印制电路板进行第一次外光成像处理,在所述印制电路板上显影出厚铜区域以及薄铜区域的所有线路;对第一次外光成像处理的印制电路板进行蚀刻处理,去除显影出的线路上的基铜;对蚀刻处理后的印制电路板进行第二次外光成像处理,在所述印制电路板上显影出厚铜区域;对显影厚铜区域的印制电路板进行镀铜处理,以使厚铜区域镀上铜层;
成型装置,用于去除所述印制电路板上的干膜,并且印制电路板上的线路两端的引线。
可选的,所述处理装置,还用于在所述印制电路板上的线路两端分别连接引线。
可选的,所述处理装置,具体用于导通所述线路两端的引线的电流,并对显影厚铜区域的印制电路板。
可选的,所述干膜具体为抗蚀刻膜。
通过上述的方法,能够有效地解决阶梯线路要求的同网络、同线路的差异铜厚问题,此方法只需要通过正片流程拉导线局部镀铜,降低生产成本,提高成品率。同时此方法可以适用于多次覆盖抗蚀膜,多次镀铜的方法,实现两层以上的阶梯线路。
附图说明
图1为本发明实施例中一种印制电路板的制备方法的流程图;
图2为本发明实施例中第一次外光成像后印制电路板的示意图;
图3为本发明实施例中蚀刻之后该印制电路板的示意图;
图4为本发明实施例中第二次外光成像后印制电路板的示意图;
图5为本发明实施例中镀铜后印制电路板的示意图;
图6为本发明实施例中退膜以及去导线处理后印制电路板的示意图;
图7为本发明实施例中一种印制电路板的制备装置的结构示意图。
具体实施方式
下面通过附图以及具体实施例对本发明技术方案做详细的说明,应当理解,本发明实施例以及实施例中的具体技术特征只是对本发明技术方案的说明,而不是限定,在不冲突的情况下,本发明实施例以及实施例中的具体技术特征可以相互组合。
如图1所示为本发明实施例中一种印制电路板的制备方法的流程图,该方法包括:
S101,对印制电路板进行第一次外光成像处理,在所述印制电路板上显影出厚铜区域以及薄铜区域的所有线路;
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