[发明专利]多处理器系统和车辆控制系统在审
申请号: | 201710592790.0 | 申请日: | 2017-07-19 |
公开(公告)号: | CN107807866A | 公开(公告)日: | 2018-03-16 |
发明(设计)人: | 川上尚孝 | 申请(专利权)人: | 瑞萨电子株式会社 |
主分类号: | G06F11/20 | 分类号: | G06F11/20;G06F11/30 |
代理公司: | 北京市金杜律师事务所11256 | 代理人: | 李辉,张昊 |
地址: | 日本*** | 国省代码: | 暂无信息 |
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摘要: | |||
搜索关键词: | 处理器 系统 车辆 控制系统 | ||
1.一种多处理器系统,包括:
第一处理器元件;
第二处理器元件;
被访问单元,被配置为通过所述第一处理器元件来访问;以及
总线机构,设置在所述第一处理器元件与所述被访问单元之间的访问路径上,其中
所述总线机构包括:
存储单元,被配置为存储与在所述第一处理器元件已执行被监控处理时发生的对所述被访问单元的访问有关的总线访问信息;
请求单元,被配置为在所述第一处理器元件已完成所述被监控处理的执行之后,请求所述第二处理器元件执行监控处理,所述监控处理的处理内容与所述被监控处理的处理内容相同;和
比较单元,被配置为将存储在所述存储单元中的与所述第一处理器元件的访问有关的总线访问信息与在所述第二处理器元件已执行所述监控处理时从所述第二处理器元件输入的总线访问信息进行比较,并且
所述第二处理器元件在空闲时间中执行所述监控处理。
2.根据权利要求1所述的多处理器系统,其中
所述第二处理器元件周期性地执行预定处理和所述监控处理,并且
所述空闲时间是一时区,在该时区内,在所述第二处理器元件中执行所述预定处理和所述监控处理的周期中不执行所述预定处理。
3.根据权利要求1所述的多处理器系统,其中
当开始所述被监控处理的执行时,所述第一处理器元件通知所述总线机构开始执行所述被监控处理,并且
所述总线机构在接收到指示开始执行所述被监控处理的通知时通过所述存储单元、所述请求单元和所述比较单元来执行处理。
4.根据权利要求3所述的多处理器系统,其中
当开始执行所述被监控处理时,所述第一处理器元件还通知所述总线机构被监控的访问范围,
所述存储单元存储与包括在所述访问范围中的访问有关的总线访问信息,其中关于所述访问范围,已作为被监控目标发送通知,并且
所述比较单元执行与包括在所述访问范围中的访问有关的总线访问信息的比较,其中关于所述访问范围,已作为所述被监控目标发送通知。
5.根据权利要求1所述的多处理器系统,其中
在所述第二处理器元件执行所述监控处理时,
响应于所述第二处理器元件对所述被访问单元的读访问请求,所述总线机构将存储在所述存储单元中的所述第一处理器元件的读数据输出至所述第二处理器元件,并且
响应于所述第二处理器元件对所述被访问单元的写访问请求,所述总线机构不执行对所述被访问单元的写访问。
6.根据权利要求1所述的多处理器系统,其中
作为关于读访问的所述总线访问信息的比较,
所述比较单元将存储在所述存储单元中的所述第一处理器元件的读地址与在所述第二处理器元件已执行所述监控处理时从所述第二处理器元件输入的读地址进行比较。
7.根据权利要求1所述的多处理器系统,其中
作为关于写访问的所述总线访问信息的比较,
所述比较单元将存储在所述存储单元中的所述第一处理器元件的写地址与在所述第二处理器元件已执行所述监控处理时从所述第二处理器元件输入的写地址进行比较,并且
所述比较单元将存储在所述存储单元中的所述第一处理器元件的写数据与在所述第二处理器元件已执行所述监控处理时从所述第二处理器元件输入的写数据进行比较。
8.根据权利要求1所述的多处理器系统,其中
所述存储单元在针对每个被监控处理设置的区中存储与在已执行所述被监控处理时发生的对所述被访问单元的访问有关的总线访问信息,并且
当在所述第一处理器元件中已发生关于另一个新的被监控处理的中断处理并且同时所述第一处理器元件正在执行所述被监控处理时,所述总线机构在一个区中存储关于所述中断处理的总线访问信息,所述一个区与在发生所述中断处理之前的被监控处理相对应的区不同。
9.根据权利要求1所述的多处理器系统,还包括错误处理单元,当所述比较单元的比较结果指示前一个和后一个总线访问信息相互不一致时,所述错误处理单元执行预定的错误处理。
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