[发明专利]从源写掩码寄存器在目的地写掩码寄存器中设置输出掩码的系统、装置和方法有效

专利信息
申请号: 201710725486.9 申请日: 2011-12-23
公开(公告)号: CN107967149B 公开(公告)日: 2021-12-10
发明(设计)人: V·W·李;D·金;T-F·奈;J·巴拉德瓦杰;A·哈特诺;S·巴格索克希;N·万苏德范 申请(专利权)人: 英特尔公司
主分类号: G06F9/30 分类号: G06F9/30
代理公司: 上海专利商标事务所有限公司 31100 代理人: 姬利永;黄嵩泉
地址: 美国加利*** 国省代码: 暂无信息
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摘要:
搜索关键词: 掩码 寄存器 目的地 设置 输出 系统 装置 方法
【说明书】:

公开了从源写掩码寄存器在目的地写掩码寄存器中设置输出掩码的系统、装置和方法。描述了用于响应于单个指令,在计算机处理器中基于向量比较执行断言掩码生成的系统、装置和方法的实施例。

本申请是国际申请日为2011年12月23日、中国国家阶段申请号为201180075865.9、题为“使用输入写掩码和立即数从源写掩码寄存器在目的地写掩码寄存器中设置输出掩码的系统、装置和方法”的发明专利申请的分案申请。

技术领域

本发明的领域一般涉及计算机处理器架构,更具体而言,涉及当执行时导致特定结果的指令。

背景技术

指令集,或指令集架构(ISA)是涉及编程的计算机架构的一部分,并可以包括本机数据类型、指令、寄存器架构、寻址模式、存储器架构、中断和异常处理、以及外部输入和输出(I/O)。应注意术语“指令”在本文中一般指的是宏指令——即提供给处理器以供执行的指令——与从处理器的解码器解码宏指令得到的微指令或微操作不同。

指令集架构与微架构不同,微架构是实现ISA的处理器的内部设计。带有不同的微架构的处理器可以共享共同的指令集。例如,英特尔Pentium(奔腾)4处理器、英特尔Core(酷睿)处理器、以及位于Sunnyvale CA的Advanced Micro Devices公司的处理器实现x86指令集的几乎相同的版本(带有被添加到较新的版本中的某些扩展),但是,具有不同的内部设计。例如,ISA的相同寄存器架构在不同的微架构中使用已知的技术以不同方法来实现,包括专用物理寄存器、使用寄存器重命名机制(诸如,如美国专利No.5,446,912所述,使用寄存器假名表(RAT)、重排序缓冲器(ROB)、以及引退寄存器组;如果美国专利No.5,207,132所述,使用多个寄存器映射和寄存器池)的一个或多个动态分配物理寄存器,等等。除非另行指出,术语寄存器架构、寄存器组和寄存器是指对软件/编程者可见的寄存器以及指令指定寄存器的方式。在需要特殊性的情况下,形容词逻辑、架构,或软件可见将用于表示寄存器架构中的寄存器/组,而不同的形容词将用于指定给定微架构中的寄存器(例如,物理寄存器、重新排序缓冲器、引退寄存器、寄存器池)。

指令集包括一个或多个指令格式。给定指令格式定义各种字段(位数、位位置)以指定要执行的操作以及将对其进行操作的操作数等。给定指令是使用给定指令格式来表达的,并指定操作和操作数。指令流是特定指令序列,其中,序列中的每一指令都是指令以指令格式出现。

科学、金融、自动向量化的通用RMS(识别、挖掘以及合成)/可视和多媒体应用(例如,2D/3D图形、图像处理、视频压缩/解压缩、语音识别算法和音频操纵)常常需要对大量的数据项执行相同操作(被称为数据并行性)。单指令多数据(SIMD)是指使处理器对多个数据项执行相同操作的一种指令。SIMD技术特别适于能够在逻辑上将寄存器中的位分为若干个固定尺寸的数据元素的处理器,每一个元素都表示单独的值。例如,64位寄存器中的位可以被指定为作为四个单独的16位数据元素来操作的源操作数,每一个数据元素都表示单独的16位值。作为另一个示例,256位寄存器中的位可以被指定为四个单独的64位打包数据元素(四字(Q)尺寸的数据元素)、八个单独的32位打包数据元素(双字(D)尺寸的数据元素)、十六个单独的16位打包数据元素(字(W)尺寸的数据元素)、或三十二个单独的8位数据元素(字节(B)尺寸的数据元素)来操作的源操作数。这种类型的数据被称为打包数据类型或向量数据类型,这种数据类型的操作数被称为打包数据操作数或向量操作数。换句话说,打包数据项或向量指的是打包数据元素的序列;并且打包数据操作数或向量操作数是SIMD指令(也称为打包数据指令或向量指令)的源操作数或目的地操作数。

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