[发明专利]一种密码攻击方法、装置及异构加速平台有效
申请号: | 201710774068.9 | 申请日: | 2017-08-31 |
公开(公告)号: | CN107425957B | 公开(公告)日: | 2021-02-19 |
发明(设计)人: | 李雪雷;王洪伟;张新 | 申请(专利权)人: | 苏州浪潮智能科技有限公司 |
主分类号: | H04L9/00 | 分类号: | H04L9/00;H04L9/08;H04K1/00 |
代理公司: | 北京集佳知识产权代理有限公司 11227 | 代理人: | 罗满 |
地址: | 215100 江苏省苏州市吴*** | 国省代码: | 江苏;32 |
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摘要: | |||
搜索关键词: | 一种 密码 攻击 方法 装置 加速 平台 | ||
1.一种密码攻击方法,其特征在于,应用于包括CPU端和FPGA端的异构平台,包括:
所述FPGA端读取预存储的彩虹表和待攻击密文数据;
所述FPGA端根据预设密码攻击算法,对所述待攻击密文数据进行并行处理,得出待选密码数据;
所述FPGA端根据预设匹配算法,将所述待选密码数据与所述彩虹表进行匹配,寻找出备选密码;
所述FPGA端向所述CPU端返回完成信号;
其中,所述预设密码攻击算法为使用OpenCL语言描述的算法;
相应地,所述FPGA端根据预设密码攻击算法,对所述待攻击密文数据进行并行处理,得出待选密码数据,包括:
利用使用OpenCL语言描述的预设密码攻击算法生成在所述FPGA端运行的Kernel程序;
利用Altera SDK for OpenCL高层次综合工具对所述Kernel程序进行编译,生成在所述FPGA端执行的可执行AOCX文件;
所述FPGA端执行所述可执行AOCX文件,以便对所述待攻击密文数据进行并行处理,得出待选密码数据;
其中,在所述FPGA端读取预存储的彩虹表和待攻击密文数据之前,还包括:
所述CPU端将所述彩虹表和所述待攻击密文数据通过预设接口传输至所述FPGA端的缓存区;设置所述FPGA端的运行参数;根据所述运行参数,向所述FPGA端发送启动指令,其中,所述运行参数包括FPGA读入位数信息、循环展开大小信息及存储信息。
2.根据权利要求1所述的密码攻击方法,其特征在于,所述FPGA端根据预设匹配算法,将所述待选密码数据与所述彩虹表进行匹配,寻找出备选密码,包括:
所述FPGA端根据所述预设匹配算法,将与所述彩虹表匹配成功的所述待选密码数据标记为真,作为所述备选密码。
3.根据权利要求2所述的密码攻击方法,其特征在于,在所述FPGA端向所述CPU端返回完成信号之后,还包括:
所述CPU端从所述FPGA端的所述缓存区读取所述备选密码。
4.根据权利要求2或3所述的密码攻击方法,其特征在于,所述预设接口为PCI-E接口,所述缓存区为DDR3。
5.一种密码攻击装置,其特征在于,应用于包括CPU端和FPGA端的异构平台,包括集成于所述FPGA端的第一读取模块、处理模块、匹配模块及返回模块;
所述第一读取模块用于读取预存储的彩虹表和待攻击密文数据;
所述处理模块用于根据预设密码攻击算法,对所述待攻击密文数据进行并行处理,得出待选密码数据;
所述匹配模块用于根据预设匹配算法,将所述待选密码数据与所述彩虹表进行匹配,寻找出备选密码;
所述返回模块用于向所述CPU端返回完成信号;
其中,所述预设密码攻击算法为使用OpenCL语言描述的算法;
相应地,所述处理模块,用于:
利用使用OpenCL语言描述的预设密码攻击算法生成在所述FPGA端运行的Kernel程序;
利用Altera SDK for OpenCL高层次综合工具对所述Kernel程序进行编译,生成在所述FPGA端执行的可执行AOCX文件;
所述FPGA端执行所述可执行AOCX文件,以便对所述待攻击密文数据进行并行处理,得出待选密码数据;
其中,所述密码攻击装置还包括集成于所述CPU端的传输模块、运行参数设置模块及启动指令发送模块;
所述传输模块用于将所述彩虹表和所述待攻击密文数据通过预设接口传输至所述FPGA端的缓存区;
所述运行参数设置模块用于设置所述FPGA端的运行参数;
所述启动指令发送模块用于根据所述运行参数,向所述FPGA端发送启动指令,其中,所述运行参数包括FPGA读入位数信息、循环展开大小信息及存储信息。
6.根据权利要求5所述的密码攻击装置,其特征在于,所述匹配模块包括:
标记子模块,用于根据所述预设匹配算法,将与所述彩虹表匹配成功的所述待选密码数据标记为真,作为所述备选密码。
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