[发明专利]多FPGA芯片间数据处理方法及转换装置有效
申请号: | 201710994136.2 | 申请日: | 2017-10-23 |
公开(公告)号: | CN107786471B | 公开(公告)日: | 2021-03-16 |
发明(设计)人: | 王克非;陈梨;王志奇;朱峰;詹晋川 | 申请(专利权)人: | 深圳市风云实业有限公司 |
主分类号: | H04L12/933 | 分类号: | H04L12/933;H04L12/951;H04L1/00 |
代理公司: | 北京润平知识产权代理有限公司 11283 | 代理人: | 金旭鹏;肖冰滨 |
地址: | 518040 广东省深圳市福田区车*** | 国省代码: | 广东;44 |
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摘要: | |||
搜索关键词: | fpga 芯片 数据处理 方法 转换 装置 | ||
1.一种多FPGA现场可编程门阵列芯片间数据处理方法,其特征在于,所述方法应用于一个FPGA芯片的转换装置中,所述转换装置用于在所述FPGA芯片的数据接口与高速收发器之间转发数据,所述方法包括:
准备待发送报文的步骤如下:
将接收的特定类型的信号数据,按照与所述特定类型对应的存储规则存储;
响应于针对所存储的信号数据的发送请求,根据公平轮转仲裁机制,将存储的信号数据读出,并封装在指定格式的报文中,以便通过所述高速收发器发送所述报文,所述指定格式的报文包括报文类型字段、序列号字段、CRC循环冗余码校验字段和数据载荷字段,其中所述数据载荷字段用于携带信号数据,所述数据载荷字段包括至少一个特定类型的信号数据,所述特定类型包括有流控的数据类型、无流控的数据类型、脉冲信号类型和电平信号类型,
其中,所述方法还包括:
将所述报文拆分为指定长度的微包,以便通过所述高速收发器按照所述微包的拆分顺序发送微包,所述指定长度与所述高速收发器的并行数据接口位宽相等,所述微包中包括位置字段和数据字段,所述位置字段用于表示所述微包在所述报文中的位置。
2.根据权利要求1所述的多FPGA芯片间数据处理方法,其特征在于,所述将接收的特定类型的信号数据,按照与所述特定类型对应的存储规则存储包括:
将从有流控的数据接口接收到的特定类型的信号数据,存储在第一深度的缓冲区内,所述特定类型为有流控的数据类型,所述第一深度与信用值的初始值相等,所述信用值由所述有流控的数据接口维护。
3.根据权利要求2所述的多FPGA芯片间数据处理方法,其特征在于,所述将存储的信号数据读出包括:
当从所述第一深度的缓冲区内读出一个信号数据时,向所述有流控的数据接口返回1个信用值。
4.根据权利要求1所述的多FPGA芯片间数据处理方法,其特征在于,所述将接收的特定类型的信号数据,按照与所述特定类型对应的存储规则存储包括:
将从无流控的数据接口接收到的特定类型的信号数据,存储在第二深度的缓冲区内,所述特定类型为无流控的数据类型。
5.根据权利要求4所述的多FPGA芯片间数据处理方法,其特征在于,所述方法还包括:
当检测到所述第二深度的缓冲区内存储空间已满,且接收到无流控的信号数据时,发出信号数据溢出的提示信息。
6.根据权利要求1所述的多FPGA芯片间数据处理方法,其特征在于,所述将接收的特定类型的信号数据,按照与所述特定类型对应的存储规则存储包括:
当接收到所述特定类型为脉冲信号类型的信号数据时,将指定计数器中的数值加1。
7.根据权利要求1所述的多FPGA芯片间数据处理方法,其特征在于,所述将接收的特定类型的信号数据,按照与所述特定类型对应的存储规则存储包括:
当接收到所述特定类型为电平信号类型的信号数据时,将所述信号数据存储在寄存器中。
8.根据权利要求1所述的多FPGA芯片间数据处理方法,其特征在于,所述方法还包括:
处理接收到的报文的步骤如下:
根据预设校验规则,对所接收的报文进行校验;
取出校验正确的报文中携带的信号数据;
根据所述信号数据的特定类型,将所述信号数据发送到与所述特定类型对应的数据接口。
9.根据权利要求8所述的多FPGA芯片间数据处理方法,其特征在于,在所述根据预设校验规则,对所接收的报文进行校验之前,所述方法还包括:
接收指定长度的微包,所述指定长度与所述高速收发器的并行数据接口位宽相等,所述微包中包括位置字段和数据字段,所述位置字段用于表示所述微包在所述报文中的位置;
根据所述位置字段,将所述微包按照接收顺序组装成对应的报文。
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