[发明专利]一种存储阵列块及半导体存储器在审

专利信息
申请号: 201711033349.5 申请日: 2017-10-30
公开(公告)号: CN107622779A 公开(公告)日: 2018-01-23
发明(设计)人: 不公告发明人 申请(专利权)人: 睿力集成电路有限公司
主分类号: G11C7/18 分类号: G11C7/18;G11C7/12;G11C8/14;G11C8/08
代理公司: 北京市铸成律师事务所11313 代理人: 张臻贤,武晨燕
地址: 230000 安徽省合肥市*** 国省代码: 安徽;34
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摘要:
搜索关键词: 一种 存储 阵列 半导体 存储器
【权利要求书】:

1.一种存储阵列块(200),其特征在于,包括:

阵列分布的多个存储阵列部(210),其中每个所述存储阵列部的内部分别设有横向分布的多个阵列负载(220);

多个行向负载(230),分别与多个存储阵列部连接;

多条列信号线(240),与沿直线纵向分布的多个所述阵列负载连接;

行信号线(250),分别与所述多个行向负载连接;

第一信号线驱动单元(260),分别与所述多条列信号线和所述行信号线连接,用于对所述列信号线连接的阵列负载和所述行信号线连接的行向负载进行驱动;及,

第二信号线驱动单元(270),与由所述行信号线和所述多条列信号线所构成群组的其中一个或两者连接,用于对由所述列信号线连接的负载和所述行信号线连接的行向负载所构成群组的其中一个或两者进行驱动。

2.根据权利要求1所述的存储阵列块,其特征在于,所述第一信号线驱动单元设置在所述行信号线和所述多条列信号线的一侧,所述第二信号线驱动单元设置在所述行信号线和/或所述多条列信号线的另一侧。

3.根据权利要求1所述的存储阵列块,其特征在于,所述第一信号线驱动单元设置在所述行信号线和所述多条列信号线的一侧,所述第二信号线驱动单元设置在所述行信号线和/或所述多条列信号线中的间隔区域。

4.根据权利要求1所述的存储阵列块,其特征在于:所述第一信号线驱动单元包括:多个列信号线驱动器(261)和一个行信号线驱动器(262);所述多个列信号线驱动器分别通过所述多条列信号线驱动所述阵列负载;所述行信号线驱动器通过所述行信号线驱动所述行向负载;

所述第二信号线驱动单元包括多个列信号驱动器(271)和一个行信号线驱动器(272);所述多个列信号线驱动器分别通过所述多条列信号线驱动所述阵列负载;所述行信号线驱动器通过所述行信号线驱动所述行向负载。

5.根据权利要求1所述的存储阵列块,其特征在于,所述第一信号线驱动单元包括:多个列信号线驱动器(261)和一个行信号线驱动器(262);所述多个列信号线驱动器分别通过所述多条列信号线驱动所述阵列负载;所述行信号线驱动器通过所述行信号线驱动所述行向负载;

所述第二信号线驱动单元包括多个列信号线驱动器(271),所述多个列信号线驱动器分别通过所述多条列信号线驱动所述阵列负载。

6.根据权利要求1所述的存储阵列块,其特征在于:所述第一信号线驱动单元包括:多个列信号线驱动器(261)和一个行信号线驱动器(262);所述多个列信号线驱动器分别通过所述多条列信号线驱动所述阵列负载;所述行信号线驱动器通过所述行信号线驱动所述行向负载;

所述第二信号线驱动单元包括一个行信号线驱动器(272),所述行信号线驱动器通过所述行信号线驱动所述行向负载。

7.根据权利要求1所述的存储阵列块,其特征在于,所述存储阵列块还包括:多个子列信号驱动器(280),分别与各所述列信号线电连接,用于驱动各该列信号线所连接的负载。

8.一种存储阵列块(700),其特征在于,包括:

阵列分布的多个存储阵列部(210),其中每个所述存储阵列部的内部分别设有横向分布的多个阵列负载(220);

多个行向负载(230),分别与多个存储阵列部连接;

多条列信号线(240),与沿直线纵向分布的多个所述阵列负载连接;

行信号线(250),分别与所述多个行向负载连接;

信号线驱动单元(260),与所述行信号线和所述多条列信号线的连接,用于对列信号线连接的阵列负载和行信号线连接的行向负载进行驱动;及,

多个子列信号驱动器(280),分别与所述列信号线电连接,用于驱动各个该列信号线上所连接的阵列负载。

9.根据权利要求8所述的存储阵列块,其特征在于,所述信号线驱动单元包括:多个列信号线驱动器和一个行信号线驱动器;所述多个列信号线驱动器分别通过所述多条列信号线驱动所述阵列负载;所述行信号线驱动器通过所述行信号线驱动所述行向负载。

10.一种半导体存储器,其特征在于,包括如权利要求1-9任意一项所述的存储阵列块。

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