[发明专利]半导体器件在审
申请号: | 201711064521.3 | 申请日: | 2017-10-31 |
公开(公告)号: | CN108074988A | 公开(公告)日: | 2018-05-25 |
发明(设计)人: | 绵贯真一;小松大士;中山知士;小仓卓;桑岛照弘 | 申请(专利权)人: | 瑞萨电子株式会社 |
主分类号: | H01L31/02 | 分类号: | H01L31/02;H01L31/105 |
代理公司: | 中国国际贸易促进委员会专利商标事务所 11038 | 代理人: | 程晨 |
地址: | 日本*** | 国省代码: | 日本;JP |
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摘要: | |||
搜索关键词: | 半导体器件 光电二极管 电容耦合 插塞 导体制造装置 硅半导体工艺 不直接接触 异种材料 污染 | ||
本发明涉及半导体器件。对半导体制造装置的锗(Ge)污染被抑制。锗是硅半导体工艺中的异种材料。半导体器件被提供有包括n型锗层的Ge光电二极管和与n型锗层电容耦合的插塞。换句话说,Ge光电二极管的n型锗层和插塞彼此不直接接触,而是彼此电容耦合。
对相关申请的交叉引用
于2016年11月16日提交的、包括说明书和权利要求书、附图和摘要的日本专利申请No.2006-223188的公开内容通过引用整体并入本文。
技术领域
本发明涉及半导体器件,例如,有效地用于具有包括锗层的受光元件的半导体器件的技术。
背景技术
日本未审查专利申请公开No.2015-92641描述了涉及光检测器件的技术,该光检测器件经由锗化物区域电耦合单晶n型Ge材料和电极。
日本未审查专利申请公开No.2013-207231描述了用于通过在Ge层上形成Si保护膜来减小电流泄漏的技术。在这种技术中,在Si保护膜与金属层接触的区域中,硅(Si)作为硅化镍层(NiSi)被完全接合到NiGe层,从而减小接触电阻。硅化镍层(NiSi)是含镍(Ni)的混晶层。
日本未审查专利申请公开No.2012-124483描述了用于减小接触电阻的技术,该技术在n型Ge区域上通过在电极和n型Ge区域之间掺杂有n型杂质的界面硅层来形成电极,从而减小接触电阻。
发明内容
在硅光子技术中,为了集成光电路和电子电路,需要具有光电转换功能的受光元件。在使用硅层作为光波导层的硅光子技术中,特别地,光电二极管(下文将称之为Ge光电二极管)用作受光元件,其中具有比硅小的带隙的锗用于吸收通过硅层传播的光(红外光)。
通过例如硅半导体工艺在硅基板上部分地外延生长Ge层,从而形成Ge光电二极管。由于Ge是硅半导体工艺中的异种材料,因此已经要求采取措施避免对半导体制造装置的污染。
通过对本说明书和附图的描述,将阐明其它问题和新特征。
根据实施例的半导体器件被提供有包括锗层的受光元件和与锗层电容耦合的插塞。
该实施例可以抑制对半导体制造装置的污染,该污染由硅半导体工艺中的异种材料锗(Ge)引起。
附图说明
图1是示出根据实施例的半导体器件的构造示例的示意图;
图2是示意性示出根据相关技术的包括Ge光电二极管的半导体器件的构造的剖面图;
图3是用于说明相关技术中的改进余地的示意图;
图4是示意性示出根据实施例的Ge光电二极管的构造的平面图;
图5是沿图4的线A-A截取的剖面图;
图6是示出根据实施例的半导体器件的制造工艺的剖面图;
图7是示出在图6之后的半导体器件的制造工艺的剖面图;
图8是示出在图7之后的半导体器件的制造工艺的剖面图;
图9是示意性示出根据第一修改的包括Ge光电二极管的半导体器件的构造的剖面图;
图10是示出根据第一修改的半导体器件的制造工艺的剖面图;
图11是示意性示出根据第三修改的包括Ge光电二极管的半导体器件的构造的剖面图;
图12是示出根据第三修改的半导体器件的制造工艺的剖面图;
图13是示出在图12之后的半导体器件的制造工艺的剖面图;
图14是示出在图13之后的半导体器件的制造工艺的剖面图;
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L31-00 对红外辐射、光、较短波长的电磁辐射,或微粒辐射敏感的,并且专门适用于把这样的辐射能转换为电能的,或者专门适用于通过这样的辐射进行电能控制的半导体器件;专门适用于制造或处理这些半导体器件或其部件的方法或
H01L31-02 .零部件
H01L31-0248 .以其半导体本体为特征的
H01L31-04 .用作转换器件的
H01L31-08 .其中的辐射控制通过该器件的电流的,例如光敏电阻器
H01L31-12 .与如在一个共用衬底内或其上形成的,一个或多个电光源,如场致发光光源在结构上相连的,并与其电光源在电气上或光学上相耦合的