[发明专利]一种全耗尽SOI结构的制作方法有效
申请号: | 201711093461.8 | 申请日: | 2017-11-08 |
公开(公告)号: | CN107887276B | 公开(公告)日: | 2019-12-03 |
发明(设计)人: | 鲍宇 | 申请(专利权)人: | 上海华力微电子有限公司 |
主分类号: | H01L21/336 | 分类号: | H01L21/336;H01L29/06 |
代理公司: | 31272 上海申新律师事务所 | 代理人: | 严罗一<国际申请>=<国际公布>=<进入 |
地址: | 201203 上海市浦*** | 国省代码: | 上海;31 |
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摘要: | |||
搜索关键词: | 一种 耗尽 soi 结构 制作方法 | ||
1.一种全耗尽SOI结构的制作方法,其特征在于,包括以下步骤:
S1:提供一半导体衬底,在所述半导体衬底的顶面设置有一埋氧层;在所述埋氧层的顶面上形成一半导体材料层,并对所述半导体材料层进行图形化;
S2:在图形化后的半导体材料层的顶面和两侧面上形成一沟道材料层,以形成一第一复合结构;
S3:去除第一复合结构中的半导体材料层,使得保留的沟道材料层与所述埋氧层围成一第一空腔;
S4:在所述保留的沟道材料层的顶面和两侧面上以及所述埋氧层的顶面上形成一第一高k介电材料层,并在所述第一空腔的内壁上形成一第二高k介电材料层,所述第二高k介电材料层围成一第二空腔;然后,在所述第一高k介电材料层上形成一第一金属背栅材料层,并填充所述第二空腔以形成一第二金属背栅材料层;
S5:去除所述第一高k介电材料层和所述第一金属背栅材料层;
S6:依次对沟道材料层、所述第二高k介电材料层进行图形化,以在俯视图中于图形化后的沟道材料层和图形化后的第二高k介电材料层的两端各暴露出一段第二金属背栅材料层,以形成第二复合结构;
S7:在所述第二复合结构的表面覆盖一氧化层,然后,减薄所述氧化层,以使减薄后的所述氧化层的顶面与所述第二复合结构中的沟道材料层的顶面齐平,以使所述沟道材料层两侧的所述氧化层形成浅沟槽隔离结构;
S8:继续完成剩余的栅极制备工艺、源漏极制备工艺,以进一步形成全耗尽SOI结构。
2.根据权利要求1所述的全耗尽SOI结构的制作方法,其特征在于,在所述S1中,所述半导体材料层的材质为Si。
3.根据权利要求1所述的全耗尽SOI结构的制作方法,其特征在于,在所述S2中,所述沟道材料层的材质选自以下任一种:SiGe,SiC,Si。
4.根据权利要求1所述的全耗尽SOI结构的制作方法,其特征在于,在所述S2中,所述沟道材料层的厚度≤100nm。
5.根据权利要求1所述的全耗尽SOI结构的制作方法,其特征在于,在所述S2中,所述沟道材料层通过外延生长形成。
6.根据权利要求1所述的全耗尽SOI结构的制作方法,其特征在于,在所述S3中,采用湿法刻蚀去除所述第一复合结构中的半导体材料层。
7.根据权利要求1所述的全耗尽SOI结构的制作方法,其特征在于,在所述S4中,采用原子层沉积方法分别形成所述第一高k介电材料层、所述第二高k介电材料层、所述第一金属背栅材料层和所述第二金属背栅材料层。
8.根据权利要求1所述的全耗尽SOI结构的制作方法,其特征在于,在所述S5中,采用湿法刻蚀去除所述第一高k介电材料层和所述第一金属背栅材料层。
9.根据权利要求1所述的全耗尽SOI结构的制作方法,其特征在于,在所述S6中,暴露出的每一段所述第二金属背栅材料层的长度>20nm。
10.根据权利要求1所述的全耗尽SOI结构的制作方法,其特征在于,在所述S7中,采用化学机械抛光方法减薄所述氧化层,所述氧化层的材质为氧化硅。
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造