[实用新型]一种异步收发器信号向MLVDS总线信号转换的装置有效
申请号: | 201720484921.9 | 申请日: | 2017-05-03 |
公开(公告)号: | CN207070064U | 公开(公告)日: | 2018-03-02 |
发明(设计)人: | 李伟;黄作兵;赵永;黄蕾 | 申请(专利权)人: | 南京国电南自维美德自动化有限公司 |
主分类号: | H04L12/02 | 分类号: | H04L12/02;H04L12/40 |
代理公司: | 南京纵横知识产权代理有限公司32224 | 代理人: | 董建林 |
地址: | 江苏省南京*** | 国省代码: | 江苏;32 |
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摘要: | |||
搜索关键词: | 一种 异步 收发 信号 mlvds 总线 转换 装置 | ||
1.一种异步收发器信号向MLVDS总线信号转换的装置,其特征在于:包括FPGA和CPU,所述CPU的第一管脚和FPGA的第二管脚相连,CPU的第二管脚和FPGA的第一管脚相连;FPGA的第三管脚和第四管脚和MLVDS总线连接。
2.根据权利要求1所述的一种异步收发器信号向MLVDS总线信号转换的装置,其特征在于:所述FPGA的型号为M2S005 。
3.根据权利要求1所述的一种异步收发器信号向MLVDS总线信号转换的装置,其特征在于:所述FPGA包括MLVDS转换的模块、MLVDS收发控制模块、串行信号发送模块以及串行信号接收模块。
4.根据权利要求3所述的一种异步收发器信号向MLVDS总线信号转换的装置,其特征在于:串行信号接收模块将接收到来自FPGA第二管脚的端口的信号转换后发送到MLVDS收发控制模块;串行信号发送模块接收从到MLVDS收发控制模块传来的信号,并将其发送到FPGA的第一管脚的端口;MLVDS收发控制模块实现异步收发器侧信号与MLVDS总线侧信号的收发控制;MLVDS转换的模块实现异步收发器信号向MLVDS总线信号的物理转换。
5.根据权利要求1所述的一种异步收发器信号向MLVDS总线信号转换的装置,其特征在于:所述CPU型号为ARM3352。
6.根据权利要求3所述的一种异步收发器信号向MLVDS总线信号转换的装置,其特征在于:所述串行信号接收模块中设有FIFO模块。
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