[实用新型]一种基于FPGA的数字调谐跳频滤波器的驱动电路有效

专利信息
申请号: 201720572614.6 申请日: 2017-05-22
公开(公告)号: CN206727972U 公开(公告)日: 2017-12-08
发明(设计)人: 裴东;邹勇;曾令栋;王辉 申请(专利权)人: 西北师范大学
主分类号: H03H9/46 分类号: H03H9/46
代理公司: 兰州智和专利代理事务所(普通合伙)62201 代理人: 周立新
地址: 730070 甘肃*** 国省代码: 甘肃;62
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摘要:
搜索关键词: 一种 基于 fpga 数字 调谐 滤波器 驱动 电路
【权利要求书】:

1.一种基于FPGA的数字调谐跳频滤波器的驱动电路,其特征在于,包括稳压电路(4)和核心控制单元(2),核心控制单元(2)分别与第二集成运放电路(7)和三路第一集成运放电路(3)相连接,第一集成运放电路(3)与四路高压驱动电路(5)相连接,第二集成运放电路(7)与两路高压驱动电路(5)相连接,高压驱动电路(5)和微波PIN开关(6)相连接;稳压电路(4)分别与核心控制单元(2)、四路集成运放电路和十四路高压驱动电路(5)相连接。

2.根据权利要求1所述的基于FPGA的数字调谐跳频滤波器的驱动电路,其特征在于,所述的核心控制单元(2)包括第一芯片(U1),第一芯片(U1)为FPGA控制芯片;第一芯片(U1)的第30脚接第一电阻(R1)的一端,第一电阻(R1)的另一端和第一二极管(D1)的负极分别接第一滤波器(F1)的第3脚;第一芯片(U1)的第34脚接第三电阻(R3)的一端,第三电阻(R3)的另一端和第二二极管(D2)的负极均接第二滤波器(F2)的第3脚;第一芯片(U1)的第37脚接第四电阻(R4)的一端,第四电阻(R4)的另一端和第三二极管(D3)的负极均接第三滤波器(F3)的第3脚,第一芯片(U1)的第37脚接第四电阻(R4)的一端,第四电阻(R4)的另一端和第四二极管(D4)的负极均接第四滤波器(F4)的第3脚,第一芯片(U1)的第42脚接第六电阻(R6)的一端,第六电阻(R6)的另一端和第五二极管(D5)的负极均接第五滤波器(F5)的第3脚,第一芯片(U1)的第46脚接第七电阻(R7)的一端,第七电阻(R7)的另一端和第六二极管(D6)的负极均接第六滤波器(F6)的第3脚,第一芯片(U1)的第49脚接第八电阻(R8)的一端,第八电阻(R8)的另一端和第七二极管(D7)的负极均接第七滤波器(F7)的第3脚,第一芯片(U1)的第50脚接第二十电阻(R20)的一端,第二十电阻(R20)的另一端和第八二极管(D8)的负极均接第八滤波器(F8)的第3脚,第一二极管(D1)的正极、第二二极管(D2)的正极、第三二极管(D3)的正极、第四二极管(D4)的正极、第五二极管(D5)的正极、第六二极管(D6)的正极、第七二极管(D7)的正极和第八二极管(D8)的正极均接地;第一芯片(U1)的第33脚接第二电阻(R2)的一端,第二电阻(R2)的另一端接集成运放电路,第一芯片(U1)的第35脚分别接第二十二电阻(R22)的一端和第二十三电阻(R23)的一端,第二十二电阻(R22)的另一端和第二十三电阻(R23)的另一端均接集成运放电路,第一芯片(U1)的第5脚、第57脚、第98脚、第26脚、第38脚、第31脚、第88脚和第一电容(C1)的一端均接+3.3V电源,第一电容(C1)的另一端接地;第一芯片(U1)的第59脚接第二十一电阻(R21)的一端,第二十一电阻(R21)的另一端接集成运放电路,第一芯片(U1)的第76脚接第十九电阻(R19)的一端,第十九电阻(R19)的另一端接集成运放电路,第一芯片(U1)的第77脚接第十八电阻(R18)的一端,第十八电阻(R18)的另一端接集成运放电路,第一芯片(U1)的第79脚接第十七电阻(R17)的一端,第十七电阻(R17)的另一端接集成运放电路,第一芯片(U1)的第80脚接第十六电阻(R16)的一端,第十六电阻(R16)的另一端接集成运放电路,第一芯片(U1)的第82脚接第十五电阻(R15)的一端,第十五电阻(R15)的一端另一端接集成运放电路,第一芯片(U1)的第86脚接第十四电阻(R14)的一端,第十四电阻(R14)的一端另一端接集成运放电路,第一芯片(U1)的第89脚接第十三电阻(R13)的一端,第十三电阻(R13)的另一端接集成运放电路,第一芯片(U1)的第91脚接第十二电阻(R12)的一端,第十二电阻(R12)的另一端接集成运放电路,第一芯片(U1)的第93脚接第十一电阻(R11)的一端,第十一电阻(R11)的一端另一端接集成运放电路,第一芯片(U1)的第94脚接第十电阻(R10)的一端,第十电阻(R10)的一端另一端接集成运放电路,第二电容(C2)的一端、第三电容(C3)的一端、第四电容(C4)的一端、第五电容(C5)的一端、第六电容(C6)的一端、第七电容(C7)的一端和第八电容(C8)的一端均接+3.3V电源,第二电容(C2)的另一端、第三电容(C3)的另一端、第四电容(C4)的另一端、第五电容(C5)的另一端、第六电容(C6)的另一端、第七电容(C7)的另一端和第八电容(C8)的另一端均接信号层接地;通信接口(J1)的第6脚和第九电容(C9)的一端信号接地,通信接口(J1)的第5脚和第九电容(C9)的另一端均接+3.3V电源;通信接口(J1)的第4脚、第3脚、第2脚和第1脚分别接第一芯片(U1)的第48脚、第83脚、第45脚和第47脚。

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