[实用新型]眼图交叉点调整电路有效

专利信息
申请号: 201720740985.0 申请日: 2017-06-23
公开(公告)号: CN207218704U 公开(公告)日: 2018-04-10
发明(设计)人: 林安;李景虎;涂航辉 申请(专利权)人: 千度芯通(厦门)微电子科技有限公司
主分类号: H04B10/69 分类号: H04B10/69;H03K3/017
代理公司: 哈尔滨市松花江专利商标事务所23109 代理人: 刘士宝
地址: 361011 福建省厦门市自由*** 国省代码: 福建;35
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摘要:
搜索关键词: 交叉点 调整 电路
【说明书】:

技术领域

本实用新型属于光纤通讯集成电路下限幅放大器技术领域,涉及对跨阻放大器输出的占空比失真的数字电压信号进行调整的电路结构。

背景技术

在光纤通讯集成电路的接收端,需要将光信号通过光电二极管(PD)转换为电流信号,再通过跨阻放大器(TIA)将电流信号转换为电压信号,如图1所示。因为跨阻放大器(TIA)内部结构的原因,它输出的一系列数字电压信号在时域上累积形成眼图的眼交叉点位置不处于0mV准线,而是处于准线之上或者之下,即占空比失真。占空比失真将不利于信号的长距离传输并降低接收机的灵敏度。因此在跨阻放大器(TIA)下一级模块限幅放大器(LA)中置入眼交叉点调整电路,将眼交叉点位置拉回0mV准线位置,最终保证数字信号的占空比为50%。

图2是数字信号时域叠加形成的眼图。图2(a)中,0mV准线正好穿过数字信号高电平与低电平的中点,即占空比为50%。在时域平面上,截取相同时间长度的数字信号片段例如t1-t2、t2-t3、t3-t4、t4-t5、叠加形成眼图,在占空比为50%的时候,眼图的交叉点P正好穿过0mV准线,如图2(b)所示。

当0mV准线低于数字信号高低电平与低电平的中点,即出现占空比失真,高电平脉冲时间轴宽度大于低电平脉冲时间轴宽度,最终数字信号所叠加形成的眼图交叉点将会位于0mV准线之上。这种占空比失真会传递较多的高电平准信号,测试时将会依此占空比比例关系验证信号误码,屏蔽及其极限值。

当0mV准线高于数字信号高低电平与低电平的中点,即出现占空比失真,高电平脉冲时间轴宽度小于低电平脉冲时间轴宽度,最终数字信号所叠加形成的眼图交叉点将会位于0mV准线之下。这种占空比失真会传递较多的低电平准信号,容易造成接收端不易从其中抽取频率,导致无法同步,进而产生同步损失。

实际应用中,跨阻放大器(TIA)输出的数字信号会出现占空比失真的问题,如果不采用电路对其进行调整,将会影响接收机的性能。

发明内容

本实用新型目的是为了解决跨阻放大器(TIA)输出数字信号存在的占空比失真,最终影响接收机整体性能的问题,提供了一种眼图交叉点调整电路。

本实用新型所述眼图交叉点调整电路,包括预放大电路和电压-电流调整单元,

参考电压VREF为预放大电路提供直流工作点,跨阻放大器TIA输出的数字信号通过交流耦合电容后保留交流小信号,交流小信号经过预放大电路幅值放大并输出待调整数字信号电压,该待调整数字信号电压用于输出给电压-电流调整单元以及限幅放大器中后级放大器;

电压-电流调整单元在芯片外部调整电压VTHP、芯片外部调整电压VTHN的控制下,输出控制指令给预放大电路,以控制承载差模小信号数字电压的直流电平大小,进而控制差模小信号数字电压绘制眼图的交叉点位置;

当跨阻放大器输出的数字信号绘制的眼图交叉点与0mV准线重合时,控制芯片外部调整电压VTHP、VTHN的电压值相等;

当跨阻放大器输出的数字信号绘制的眼图交叉点在0mV准线上方时,保持芯片外部调整电压VTHN电压值不变,调节芯片外部调整电压VTHP逐渐调低,以使差模小信号数字电压绘制眼图的交叉点下移,直至到达0mV准线,停止调节芯片外部调整电压VTHP;

当跨阻放大器输出的数字信号绘制的眼图交叉点在0mV准线下方时,保持芯片外部调整电压VTHN电压值不变,调节芯片外部调整电压VTHP的电压逐渐调高,以使差模小信号数字电压绘制眼图的交叉点上移,直至到达0mV准线,停止调节芯片外部调整电压VTHP。

优选地,预放大电路包括NPN晶体管Q1~Q4和电阻R1~R5;

NPN晶体管Q1的基极通过电容C1连接跨阻放大器TIA的正向输出端;

参考电压VREF通过电阻R8为电容C1输出的交流小信号提供直流工作点;

NPN晶体管Q2的基极通过电容C2连接跨阻放大器TIA的反向输出端;

参考电压VREF通过电阻R9为电容C2输出的交流小信号提供直流工作点;

NPN晶体管Q1的集电极同时连接电阻R4的一端、NPN晶体管Q5的集电极和待调整数字电压输出节点B;

NPN晶体管Q2的集电极同时连接电阻R5的一端、NPN晶体管Q6的集电极和待调整数字电压输出节点A;

NPN晶体管Q1的发射极同时连接电阻R1的一端和NPN晶体管Q3的集电极;

NPN晶体管Q2的发射极同时连接电阻R1的另一端和NPN晶体管Q4的集电极;

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