[实用新型]存储器测试装置有效

专利信息
申请号: 201721751730.0 申请日: 2017-12-14
公开(公告)号: CN207690508U 公开(公告)日: 2018-08-03
发明(设计)人: 不公告发明人 申请(专利权)人: 睿力集成电路有限公司
主分类号: G11C29/56 分类号: G11C29/56
代理公司: 北京市铸成律师事务所 11313 代理人: 张臻贤;武晨燕
地址: 230000 安徽省合肥市*** 国省代码: 安徽;34
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摘要:
搜索关键词: 存储器电路 振荡信号 数据处理 环形振荡电路 处理数据 存储器测试装置 存储器 计数电路 开始信号 脉冲周期 本实用新型 存储电路 信号停止 性能开发 振荡电路 响应 研发 配置 测量 输出 开发
【说明书】:

一种存储器测试装置,所述装置包括环形振荡电路以及计数电路。环形振荡电路配置为从存储器电路接收数据处理开始信号,并且响应于所述数据处理开始信号发生振荡信号,并从所述存储器电路接收数据处理结束信号,并且响应于所述数据处理结束信号停止发生所述振荡信号。计数电路配置为接收所述环形振荡电路输出的振荡信号,计算在所述振荡信号持续的时间内,所述振荡电路中的脉冲周期数,以根据所述脉冲周期数确定所述存储电路处理数据的时间。本实用新型技术方案可以实现测量所述存储器电路处理数据的时间,根据存储器电路的处理数据的时间来进行存储器的其他性能开发,这样便于研发人员更有效率地对存储器进行开发。

技术领域

本实用新型涉及信息存储技术领域,具体涉及一种存储器测试装置。

背景技术

存储器广泛应用于集成电路领域。衡量存储器性能的指标包括存储速度、存储容量、延迟时间等指标。

图1为传统技术中包括存储器电路10的示意图,其中存储器电路10包括存储阵列,当读/写控制器通过读/写控制端接收到读写控制信号时,需要经过地址码输入和片选确定存储阵列的地址,将输入/输出端接收到的数据存储至存储阵列。由于读/写存储器中的数据时共用一条总线(BUS),因此需要在存储器电路中设置金属氧化物半导体(Metal OxideSemiconductor,MOS)管作为控制开关,当有一组数据传输时,控制MOS管打开,数据开始传输,当该一组数据传输完成时,控制MOS管关闭,然后开始下一组数据的传输。但实际的数据传输并没有那么简单,而是经过放大器、多个选择器、反相器和先入先出队列(First InputFirst Output,FIFO),最后才输出至用户界面上。也就是说数据传输时要经过很长的路线。

传统技术在存储器技术开发过程中,无法获知每组数据的传输情况,需要通过测试才能了解数据是否传输完毕,因此降低了研发人员的工作效率。

实用新型内容

本实用新型提供了一种存储器测试装置,以至少解决现有技术中的以上技术问题。

作为本实用新型的一个方面,本实用新型实施例提供一种存储器测试装置,包括:

环形振荡电路,配置为从存储器电路接收数据处理开始信号,并且响应于所述数据处理开始信号发生振荡信号;以及从所述存储器电路接收数据处理结束信号,并且响应于所述数据处理结束信号停止发生所述振荡信号;以及

计数电路,配置为接收所述环形振荡电路输出的振荡信号,计算在所述振荡信号持续的时间内,所述振荡电路中的脉冲周期数,以根据所述脉冲周期数确定所述存储器电路处理数据的时间。

结合第一方面,本实用新型第一方面的第一实施方式中,所述环形振荡电

路包括:

多个串联连接的反相器,其中所述反相器的数量为奇数;以及

逻辑与电路,所述逻辑与电路的一个输入端接收所述数据处理开始信号和所述数据处理结束信号,所述逻辑与电路的输出端连接到多个所述反相器中第一个反相器的输入端,以及多个所述反相器中的最后一个反相器的输出端连接所述逻辑与电路的另一个输入端。

结合第一方面,本实用新型第一方面的第二实施方式中,所述计数电路包括:

除频电路,配置为接收所述环形振荡电路发送的振荡信号,并将所述振荡信号除频处理;以及

二进制计数器,配置为将所述除频后的振荡信号进行计时。

结合第一方面,本实用新型第一方面的第三实施方式中,所述数据处理开始信号为用于表示所述存储器电路开始执行数据处理的信号;以及所述数据处理结束信号为用于表示所述存储器电路结束执行数据处理的信号。

结合第一方面,本实用新型第一方面的第四实施方式中,所述数据处理包括对数据的存储操作或对数据的读取操作。

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