[发明专利]一种用于高速多路接口总线的差分时钟树电路在审
| 申请号： | 201810127162.X | 申请日： | 2018-02-08 |
| 公开（公告）号： | CN108233918A | 公开（公告）日： | 2018-06-29 |
| 发明（设计）人： | 郝允熙;陈纲 | 申请（专利权）人： | 高科创芯（北京）科技有限公司 |
| 主分类号： | H03K19/0175 | 分类号： | H03K19/0175;H03K19/0185 |
| 代理公司： | 北京易正达专利代理有限公司 11518 | 代理人： | 程宝妹 |
| 地址： | 100080 北京*** | 国省代码： | 北京;11 |
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| 摘要： | |||
| 搜索关键词： | 差分时钟 树电路 接口总线 低抖动 多路 级联 长距离传输 抗噪声能力 高速时钟 噪声 集电极串联电阻 全差分结构 输入/输出 差分结构 差分信号 场效应管 级联电路 驱动能力 晶体管 能力强 全模拟 摆幅 成对 偏置 屏蔽 对称 电源 供电 传输 | ||
【权利要求书】：
1.一种用于高速多路接口总线的差分时钟树电路，其特征在于，包含多级差分子时钟电路；所述每级差分子时钟电路包含晶体管M1和晶体管M2组成的差分电路，所述晶体管M1的漏极D串联电阻R1，在晶体管M2的漏极D串联电阻R2，晶体管M1和晶体管M2的源极S均与场效应管MB1的漏极D电相连，所述场效应管MB1的源极S接地；晶体管M1和晶体管M2的漏极D分别作为差分信号的两个输出端。
2.根据权利要求1所述用于高速多路接口总线的差分时钟树电路，其特征在于，所述多级差分子时钟电路至少为2级。
3.根据权利要求2所述用于高速多路接口总线的差分时钟树电路，其特征在于，在所述多级差分子时钟电路中，次级的差分子时钟电路的两个晶体管的栅极G分别连接上一级差分子时钟电路的对应晶体管的漏极D；次级差分子时钟电路的场效应管的栅极G与上一级差分子时钟电路的场效应管的栅极G直连。
4.根据权利要求1或3所述用于高速多路接口总线的差分时钟树电路，其特征在于，在工作状态下，所述晶体管M1和晶体管M2的栅极G分别加有工作电压VINA、VINB；所述场效应管MB1的栅极G加有偏置电压Vbias。
5.根据权利要求1或3所述用于高速多路接口总线的差分时钟树电路，其特征在于，所述晶体管M1、晶体管M2和场效应管MB1为P型场效应管。
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