[发明专利]具有固定带宽接口的存储器设备中的集成的错误检查和校正(ECC)在审
申请号: | 201810170935.2 | 申请日: | 2018-03-01 |
公开(公告)号: | CN108538337A | 公开(公告)日: | 2018-09-14 |
发明(设计)人: | C·E·考克斯;U·康;N·阿布伦宁 | 申请(专利权)人: | 英特尔公司 |
主分类号: | G11C29/42 | 分类号: | G11C29/42;G11C29/12 |
代理公司: | 永新专利商标代理有限公司 72002 | 代理人: | 刘瑜;王英 |
地址: | 美国加*** | 国省代码: | 美国;US |
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摘要: | |||
搜索关键词: | 存储器管芯 存储器设备 连接器 错误检查 固定带宽 多管芯 校正 选择性地连接 存储器通道 存储器阵列 第二存储器 选择性应用 输入/输出 比特组合 管芯接口 设备接口 信号应用 字节模式 数据I/O 列地址 存取 应用 电路 配置 交换 | ||
一种具有固定带宽接口的多管芯存储器设备可以选择性地将多个存储器管芯的接口的部分连接作为用于多管芯设备的存储器通道。存储器管芯的接口比特的选择性应用使得在没有足够的连接器来交换ECC信息的存储器设备中ECC(错误检查和校正)的应用。该装置包括用于选择性地将CAS(列地址选择)信号应用于存储器管芯以选择性地连接存储器管芯的连接器的电路。CAS选择可以提供各种配置,其中第一存储器管芯接口的所选择的比特与第二存储器管芯接口的所选择的比特或多个比特组合以提供设备接口。存储器管芯可以在字节模式中操作,以只应用其数据I/O(输入/输出)接口的一半,并将CAS加倍以提供对存储器阵列的存取。
优先权
本申请是基于2017年3月2日提交的美国临时申请第62/465,837号的非临时申请,并且要求该申请的优先权益。该临时申请通过引用被并入到本文中。
技术领域
本描述总体上涉及计算机存储器系统,并且更具体的描述涉及将错误检查和校正集成在能够进行字节模式操作的存储器设备中。
背景技术
包括服务器、桌面型计算机或膝上型计算机、移动设备、或消费性和商业电子产品的几乎任何各种电子设备都利用存储器资源来存储并且管理数据以及代码以用于由处理资源执行。存储器设备制造工艺特征几何尺寸持续缩小,这使得存储器密度持续增加。然而,缩放为更高的密度很可能会增加存储器设备中的错误的数量。一种用于解决存储器错误的技术是采用ECC(错误检查和校正,也被称为纠错编码)。传统地,存储器控制器执行错误检查和校正。
然而,使用ECC通常需要交换更多的数据比特,这可能需要总线宽度增加以及到存储器设备数据接口的相对应的改变。低功耗存储器设备通常具有x16接口、或者具有16个连接器和相对应的16个内部数据路径的数据总线接口。因此,ECC应用于低功耗存储器设备通常涉及添加第二设备、或添加接近两倍的存储器以允许ECC。虽然浪费了资源,但是存储器设备的数量加倍通常是仅有的实际的选项,出于ECC的目的实现到低功耗存储器的接口改变,将会需要对存储器的I/O(输入/输出)接口的大量的重新设计和大量的内部重新设计以提供信号线以用于ECC信息的交换。
因此,针对其中ECC被认为是必要的系统,传统地会使用非低功耗存储器。然而,存在操作条件,例如,高温度环境,其中低功耗存储器比标准商品存储器表现得更好。在这样的系统中,使用低功耗存储器设备,并且为了能够实现ECC,系统将被部署有所需要的多个设备。
附图说明
以下描述包括对附图的讨论,该讨论具有通过本发明的实现的示例给出的示例性示出。附图应当通过示例而不是通过限制的方式来理解。如本文中所使用的,对一个或多个“实施例”或“示例”的引用将被理解为描述包括在本发明的至少一个实现中的特定特征、结构、和/或特性。因此,出现在本文中的短语(例如,“在一个示例中”或“在可替代实现中”)描述了本发明的各种示例和实现,并且不一定所有都指代相同的示例。然而,它们也不一定相互排斥。
图1是用于将ECC应用于具有固定的通道宽度而没有传统的ECC比特分配的多芯片存储器的系统的示例的框图。
图2A是存储器设备接口的示例的表示,其中在字节模式中使用的x16接口实现x9接口以用于ECC的实现。
图2B是设备的示例的框图,其中在字节模式中使用的x16接口实现x9接口以用于ECC的实现。
图3A是存储器设备的示例的表示,其中添加附加的I/O路径以在两个x16设备之上扩展数据和ECC比特路径,以实现三个x9接口以用于ECC的实现。
图3B是设备的示例的框图,其中在固定宽度的通道内添加附加的I/O路径以在两个x16设备之上扩展数据和ECC比特路径,以实现三个x9接口以用于ECC的实现。
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