[发明专利]缓冲存储器中的推测性读有效

专利信息
申请号: 201810200618.0 申请日: 2015-11-26
公开(公告)号: CN108829614B 公开(公告)日: 2022-11-01
发明(设计)人: B.S.莫里斯;B.纳尔;R.G.布兰肯希普;Y-C.刘 申请(专利权)人: 英特尔公司
主分类号: G06F12/0831 分类号: G06F12/0831;G06F12/0862;G06F12/0884
代理公司: 中国专利代理(香港)有限公司 72001 代理人: 姜冰;张金金
地址: 美国加利*** 国省代码: 暂无信息
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摘要:
搜索关键词: 缓冲存储器 中的 推测
【权利要求书】:

1.一种用于管理存储器的设备,所述设备包括:

转换性存储器缓冲器TMXB装置,包括:

接收器,用于在接口上从主机控制器接收推测性读请求,其中所述推测性存储器读请求标识存储器中的具体地址,并且所述接口使用另一个互连协议的链路层和物理层;

调度器;以及

存储器控制器,用于:

基于所述推测性读请求从所述具体地址获得数据;

将所述数据存储在缓冲器中;

标识来自所述主机控制器的对应于所述推测性读请求的需求读;以及

生成包括所述数据的读返回,其中响应于所述需求读,所述读返回要在所述接口上被发送到所述主机控制器。

2.如权利要求1所述的设备,其中所述TMXB装置提取用于从所述主机控制器访问所述存储器的存储器协议的细节。

3.如权利要求1所述的设备,其中所述TMXB装置要与所述存储器进行对接。

4.如权利要求3所述的设备,其中所述存储器包括两级存储器拓扑中的近存储器和远存储器。

5.如权利要求3所述的设备,其中所述存储器包括动态随机访问存储器(DRAM)。

6.如权利要求1-5的任一项所述的设备,其中使用双倍数据率(DDR)存储器协议从所述存储器来访问所述数据。

7.如权利要求1-5的任一项所述的设备,其中当没有对应的需求读被接收时,数据要被丢弃。

8.如权利要求1-5的任一项所述的设备,其中当在定义的持续时间内对应的需求读未被接收时,数据要被丢弃。

9.如权利要求1-5的任一项所述的设备,其中推测性读不包含事务标识符。

10.如权利要求9所述的设备,其中需求读包含事务标识符,并且所述读返回标识相同事务标识符。

11.如权利要求1-5的任一项所述的设备,其中所述需求读从归属代理器被接收。

12.如权利要求1-5的任一项所述的设备,其中所述需求读修改对应的目录状态。

13.如权利要求1-5的任一项所述的设备,其中所述需求读不修改对应的目录状态。

14.一种用于管理计算机存储器的方法,所述方法包括:

在接口上从主机控制器在存储器控制器接收推测性读请求,其中所述推测性存储器读请求标识存储器中的具体地址;

基于所述推测性读请求从所述具体地址获得数据;

将所述数据存储在所述存储器控制器的缓冲器中;

标识来自所述主机控制器的对应于所述推测性读请求的需求读;以及

生成包括所述数据的读返回,其中响应于所述需求读,所述读返回要在所述接口上被发送到所述主机控制器。

15.如权利要求14所述的方法,其中对应于所述推测性读请求的读返回不要被发送,直到所述对应的需求读被接收。

16.如权利要求15所述的方法,其中当没有对应的需求读被接收时,数据要被丢弃。

17.如权利要求15所述的方法,其中当在定义的持续时间内对应的需求读未被接收时,数据要被丢弃。

18.一种用于管理存储器的系统,包括用于执行如权利要求14-17的任一项所述的方法的部件。

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