[发明专利]一种基于CPLD-FPGA的服务器上电时序检测方法与系统在审
| 申请号： | 201810287686.5 | 申请日： | 2018-04-03 |
| 公开（公告）号： | CN108804275A | 公开（公告）日： | 2018-11-13 |
| 发明（设计）人： | 季冬冬 | 申请（专利权）人： | 郑州云海信息技术有限公司 |
| 主分类号： | G06F11/28 | 分类号： | G06F11/28;G06F11/32 |
| 代理公司： | 济南诚智商标专利事务所有限公司 37105 | 代理人： | 李修杰 |
| 地址： | 450018 河南省郑州市*** | 国省代码： | 河南;41 |
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| 摘要： | |||
| 搜索关键词： | 服务器 上电测试 上电时序 使能 万用表 状态机寄存器 测量电压 点亮测试 起电状态 上电状态 设置状态 依次显示 有效减少 直观显示 制造成本 寄存器 状态机 监测 检测 直观 输出 保存 保留 | ||
1.一种基于CPLD-FPGA的服务器上电时序检测方法，其特征在于，包括以下步骤：
S1、设置状态机寄存器；
S2、当前状态下，开启当前VR，并经CPLD-FPGA输出PWRGD信号；
S3、当监测到PWRGD信号时，状态机寄存器保存当前状态值，并点亮测试LED；
S4、如果当前VR使能，状态机进入下一状态，并进行下一状态下的VR开启；如果当前VR使能异常，则保留当前状态值；
S5、依次显示各个起电状态。
2.根据权利要求1所述的一种基于CPLD-FPGA的服务器上电时序检测方法，其特征在于，所述状态机寄存器用于状态机状态值的实时保存和输出，作为测试LED状态的控制端。
3.根据权利要求2所述的一种基于CPLD-FPGA的服务器上电时序检测方法，其特征在于，所述步骤S3具体包括以下操作：
S301、当PWGRD为“1”时，状态机寄存器保存当前状态值；
S302、输出当前状态值，作为测试LED的控制端。
4.根据权利要求1-3任意一项所述的一种基于CPLD-FPGA的服务器上电时序检测方法，其特征在于，所述LED的链路中还包括调节电阻，所述调节电阻用于调节LED灯亮度。
5.一种基于CPLD-FPGA的服务器上电时序检测系统，其特征在于，包括：
状态机寄存器模块，用于设置状态机寄存器；
信号转换模块，用于当前状态下，开启当前VR，并经CPLD-FPGA输出PWRGD信号；
LED点亮模块，用于当监测到PWRGD信号时，状态机寄存器保存当前状态值，并点亮测试LED；
VR使能监测模块，用于如果当前VR使能，状态机进入下一状态，并进行下一状态下的VR开启；如果当前VR使能异常，则保留当前状态值；
起电状态显示模块，用于依次显示各个起电状态。
6.根据权利要求5所述的一种基于CPLD-FPGA的服务器上电时序检测系统，其特征在于，所述状态机寄存器用于状态机状态值的实时保存和输出，作为测试LED状态的控制端。
7.根据权利要求6所述的一种基于CPLD-FPGA的服务器上电时序检测系统，其特征在于，所述LED点亮模块包括：
PWRGD信号监测单元，用于当PWGRD为“1”时，状态机寄存器保存当前状态值；
状态值输出单元，用于输出当前状态值，作为测试LED的控制端。
8.根据权利要求5-7任意一项所述的一种基于CPLD-FPGA的服务器上电时序检测系统，其特征在于，所述LED的链路中还包括调节电阻，所述调节电阻用于调节LED灯亮度。
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