[发明专利]一种半导体结构及其形成方法有效
申请号: | 201810565371.2 | 申请日: | 2018-06-04 |
公开(公告)号: | CN110556299B | 公开(公告)日: | 2021-11-16 |
发明(设计)人: | 牛刚 | 申请(专利权)人: | 中芯国际集成电路制造(天津)有限公司;中芯国际集成电路制造(上海)有限公司 |
主分类号: | H01L21/48 | 分类号: | H01L21/48;H01L23/498 |
代理公司: | 北京睿派知识产权代理事务所(普通合伙) 11597 | 代理人: | 刘锋 |
地址: | 300000 天津*** | 国省代码: | 天津;12 |
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摘要: | |||
搜索关键词: | 一种 半导体 结构 及其 形成 方法 | ||
1.一种半导体结构的形成方法,其特征在于,包括:
提供半导体衬底,所述半导体衬底包括金属间介电层以及位于所述金属间介电层上的上层金属电极;
形成钝化层,所述钝化层覆盖所述上层金属电极和所述金属间介电层;
在钝化层表面上相邻的上层金属电极之间的位置刻蚀形成第一凹槽;
形成露出上层金属电极的通孔;
在所述通孔中形成金属柱;
其中,所述方法还包括在形成所述通孔前,在所述上层金属电极的上方的钝化层表面形成第二凹槽;
其中,所述第二凹槽的宽度大于所述通孔的宽度,所述通孔和所述第二凹槽共同组成露出所述上层金属电极的阶梯状结构;
所述金属柱为阶梯状结构,所述金属柱的横截面尺寸由下至上依次增大;
其中,所述第一凹槽和所述第二凹槽通过同一道刻蚀工序形成;
其中,所述钝化层包括依次叠置的二氧化硅层和氮化硅层;
其中,所述第一凹槽和所述第二凹槽的深度相同且小于所述氮化硅层的厚度。
2.根据权利要求1所述的半导体结构的形成方法,其特征在于,所述第一凹槽宽度小于或等于相邻所述金属柱间的距离。
3.根据权利要求1所述的半导体结构的形成方法,其特征在于,使用各向异性的干法刻蚀刻蚀所述钝化层,形成所述第一凹槽和所述第二凹槽。
4.一种半导体结构,其特征在于,包括:
依次叠置的半导体衬底、金属间介电层、上层金属电极;
钝化层,覆盖所述金属间介电层并具有露出所述上层金属电极的通孔;以及
形成于所述钝化层上,通过所述通孔与所述上层金属电极相互连接的金属柱;
其中,所述钝化层表面上相邻的上层金属电极之间的位置形成有第一凹槽以使得相邻的金属柱之间的钝化层形成为阶梯状;
其中,所述半导体结构还包括在所述上层金属电极的上方的钝化层形成有第二凹槽;
其中,所述第二凹槽的宽度大于所述通孔的宽度以使所述金属柱具有阶梯状结构;
所述金属柱的横截面尺寸由下至上依次增大;其中,所述钝化层包括依次叠置的二氧化硅层和氮化硅层;
其中,所述第一凹槽和所述第二凹槽的深度相同且小于所述氮化硅层的厚度。
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造