[发明专利]一种双CPU多中断双口RAM共享内存方法有效
申请号: | 201810577908.7 | 申请日: | 2018-06-07 |
公开(公告)号: | CN110580201B | 公开(公告)日: | 2022-07-22 |
发明(设计)人: | 倪群辉;侯炜;陈俊;石勇;周进;江长青 | 申请(专利权)人: | 南京南瑞继保电气有限公司;南京南瑞继保工程技术有限公司 |
主分类号: | G06F9/54 | 分类号: | G06F9/54;G06F13/26 |
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地址: | 211102 江*** | 国省代码: | 江苏;32 |
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摘要: | |||
搜索关键词: | 一种 cpu 中断 ram 共享 内存 方法 | ||
1.一种双CPU多中断双口RAM共享内存方法,其特征在于:所述方法包括:
(1)装置内部包括第一CPU、第二CPU和双口RAM;
(2)根据功能需求将双口RAM分为3个区域,其中区域1存放实时性数据,区域2存放非实时数据,区域3存放数据写入结束标志;
(3)第一CPU设置两个中断,分别为中断1、中断2;第二CPU设置两个中断,分别为中断3、中断4;第一CPU中断1优先级高于中断2;第二CPU中断3优先级高于中断4;通过第一CPU中断1和第二CPU中断3实现双口RAM区域1实时性数据和区域3写入结束标志数据的交互;通过第一CPU中断2和第二CPU中断4实现双口RAM区域2非实时数据的交互;
(4)通过第一CPU和第二CPU的中断配合以及写允许开关,保证同一时刻仅有一个CPU对双口RAM某一个区域进行访问,以及实现第一CPU与第二CPU之间数据的快速可靠传输。
2.根据权利要求1所述的一种双CPU多中断双口RAM共享内存方法,其特征在于,将实时性数据和非实时性数据分别存放在双口RAM共享内存中的不同区域,实时性数据在高优先级中断下实现快速可靠传输,非实时性数据在低优先级中断下实现数据的可靠传输。
3.根据权利要求1所述的一种双CPU多中断双口RAM共享内存方法,其特征在于,所述写允许开关用于控制第二CPU对双口RAM的写允许操作。
4.根据权利要求1所述的一种双CPU多中断双口RAM共享内存方法,其特征在于,正常运行情况下,第一CPU中断1将实时数据写入双口RAM区域1,当第一CPU中断1运行结束后,触发第二CPU中断3,第二CPU中断3对区域1实时数据进行读取。
5.根据权利要求4所述的一种双CPU多中断双口RAM共享内存方法,其特征在于,第一CPU在中断1开始时对双口RAM区域1及区域3进行数据读写操作,当双口RAM区域3数据写入结束标志被置位时,禁止第二CPU对双口RAM进行写操作,上述步骤完成后向第二CPU发出中断触发信号;第二CPU收到中断触发信号后,进入第二CPU中断3,对双口RAM区域1及区域3中的数据进行读写操作。
6.根据权利要求1所述的一种双CPU多中断双口RAM共享内存方法,其特征在于,需要更改非实时数据时,第二CPU中断4向双口RAM区域2写入需要修改的非实时数据,待非实时数据写入完成后,第二CPU中断3将双口RAM区域3写入结束标志置位,第一CPU中断1读取双口RAM区域3的结束标志置位后,通过写允许开关禁止第二CPU向双口RAM写入数据,第一CPU中断2开始读取双口RAM区域2中的非实时数据;待非实时数据读取结束后,将区域3中的写入结束标志清除,并通过写允许开关开放第二CPU向双口RAM写入数据。
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