[发明专利]存储系统和存储控制装置有效

专利信息
申请号: 201810699164.6 申请日: 2018-06-29
公开(公告)号: CN110660429B 公开(公告)日: 2021-09-14
发明(设计)人: 吴聿旻 申请(专利权)人: 华为技术有限公司
主分类号: G11C11/4076 分类号: G11C11/4076
代理公司: 北京龙双利达知识产权代理有限公司 11329 代理人: 周乔;王君
地址: 518129 广东*** 国省代码: 广东;44
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摘要:
搜索关键词: 存储系统 存储 控制 装置
【权利要求书】:

1.一种存储系统,其特征在于,所述存储系统包括:第一时钟装置、第一存储控制装置、第二存储控制装置,和存储装置,其中所述第一时钟装置与所述第一存储控制装置相连,所述第一时钟装置与所述第二存储控制装置相连,所述第一存储控制装置与所述存储装置相连,所述第二存储控制装置与所述存储装置相连;

所述第一时钟装置,用于生成第一时钟信号并将所述第一时钟信号发送至所述第一存储控制装置和所述第二存储控制装置;

所述第一存储控制装置,用于接收所述第一时钟信号并将所述第一时钟信号发送至所述存储装置;

所述第二存储控制装置,用于接收所述第一时钟信号并将所述第一时钟信号发送至所述存储装置;

所述存储装置,用于从所述第一存储控制装置和所述第二存储控制装置接收所述第一时钟信号;以及,根据所述第一时钟信号进行数据读写;

所述存储装置,具体用于当从所述第一存储控制装置无法接收到所述第一时钟信号的时候,根据从所述第二存储控制装置接收到的所述第一时钟信号进行数据读写。

2.如权利要求1所述的存储系统,其特征在于,所述存储系统,还包括:第二时钟装置,其中所述第二时钟装置与所述第一存储控制装置相连,所述第二时钟装置与所述第二存储控制装置相连;

所述第二时钟装置,用于生成第二时钟信号,并将所述第二时钟信号发送至所述第一存储控制装置和所述第二存储控制装置;

所述第一存储控制装置,还用于在无法接收到所述第一时钟信号时接收所述第二时钟信号并将所述第二时钟信号发送至所述存储装置;

所述第二存储控制装置,还用于在无法接收到所述第一时钟信号时接收所述第二时钟信号并将所述第二时钟信号发送至所述存储装置;

所述存储装置,用于从所述第一存储控制装置和所述第二存储控制装置接收所述第二时钟信号;根据所述第二时钟信号进行数据读写。

3.如权利要求2所述的存储系统,其特征在于,所述第二时钟装置与所述第一时钟装置相连;

所述第一时钟装置,还用于将生成的所述第一时钟信号发送至所述第二时钟装置;

所述第二时钟装置,还用于将接收到的所述第一时钟信号转发至所述第一存储控制装置和所述第二存储控制装置;将生成的所述第二时钟信号发送至所述第一时钟装置;

所述第一时钟装置,还用于将接收到的所述第二时钟信号转发至所述第一存储控制装置和所述第二存储控制装置。

4.如权利要求3所述的存储系统,其特征在于,所述第一时钟装置包括第一端口和第二端口,所述第二时钟装置包括第三端口和第四端口,其中所述第一端口与所述第三端口相连,所述第二端口与所述第四端口相连,

所述第一时钟装置,还用于通过所述第一端口或所述第二端口将所述第一时钟信号发送至所述第二时钟装置;

所述第二时钟装置,还用于通过所述第三端口或所述第四端口将所述第二时钟信号发送至所述第一时钟装置。

5.如权利要求3或4所述的存储系统,其特征在于,

所述第一存储控制装置,还用于在确定时钟信号源从所述第一时钟装置切换至所述第二时钟装置的情况下,对所述第二时钟信号进行相位锁止和多周期缓慢移相;

所述第二存储控制装置,还用于在确定时钟信号源从所述第一时钟装置切换至所述第二时钟装置的情况下,对所述第二时钟信号进行相位锁止和多周期缓慢移相。

6.如权利要求5所述的存储系统,其特征在于,

所述存储装置,还用于在确定所述时钟信号源从所述第一时钟装置切换至所述第二时钟装置的情况下,对所述第二时钟信号进行相位锁止和多周期缓慢移相。

7.如权利要求5所述的存储系统,其特征在于,

所述第二时钟装置,还用于在确定所述时钟信号源从所述第一时钟装置切换至所述第二时钟装置的情况下,对所述第二时钟信号进行相位锁止和多周期缓慢移相。

8.如权利要求1至4中任一项所述的存储系统,其特征在于,

所述存储装置,还用于在无法从所述第一存储控制装置接收到时钟信号的情况下,向所述第一存储控制装置发送第一告警信息,所述第一告警信息用于指示所述存储装置无法从所述第一存储控制装置接收所述时钟信号;

所述存储装置,还用于在无法从所述第二存储控制装置接收到所述时钟信号的情况下,向所述第二存储控制装置发送第二告警信息,所述第二告警信息用于指示所述存储装置无法从所述第二存储控制装置接收所述时钟信号。

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