[发明专利]移位寄存器单元、栅极驱动电路、显示装置及驱动方法有效

专利信息
申请号: 201810772573.4 申请日: 2018-07-13
公开(公告)号: CN108665846B 公开(公告)日: 2022-01-28
发明(设计)人: 杜瑞芳;马小叶 申请(专利权)人: 京东方科技集团股份有限公司;合肥鑫晟光电科技有限公司
主分类号: G09G3/20 分类号: G09G3/20;G11C19/28
代理公司: 北京中博世达专利商标代理有限公司 11274 代理人: 申健
地址: 100015 *** 国省代码: 北京;11
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摘要:
搜索关键词: 移位寄存器 单元 栅极 驱动 电路 显示装置 方法
【说明书】:

发明提供一种移位寄存器单元、栅极驱动电路、显示装置及驱动方法,涉及显示技术领域,该移位寄存器器单元在正常温度和低温下均可以正常工作,且在正常温度下工作时,能减小耦合噪声和节省功耗。移位寄存器单元包括第一输出子电路和第二输出子电路;第一输出子电路用于在控制电压端和上拉节点的电压的控制下,将时钟信号端的信号输出至输出端;第二输出子电路用于在上拉节点的电压的控制下,将时钟信号端的信号输出至输出端。

技术领域

本发明涉及显示技术领域,尤其涉及一种移位寄存器单元、栅极驱动电路、显示装置及驱动方法。

背景技术

GOA(Gate Driver on Array,阵列基板行驱动)技术,即在玻璃基板上集成TFT(Thin Film Transistor,薄膜场效应晶体管)组成的栅极驱动电路。由于具有降低成本、提升模组工艺产量、利于实现窄边框等优点,得到了广泛的应用。GOA技术的设计关键点是,移位寄存电路和该电路的信赖。

现有栅极驱动电路中的输出晶体管连接上拉节点、时钟信号线以及输出端。在输出阶段,输出晶体管在上拉节点的控制下,将时钟信号线的信号输出至输出端。对于a-Si工艺的面板来讲,低温下其晶体管的迁移率下降,使得通过该晶体管的电流Ion大幅度降低,从而不利于显示器的正常工作。

目前,为了使得显示产品例如车载产品,能在各个温度环境尤其是低温下均适用,通常栅极驱动电路中的输出晶体管的尺寸设计的较大,然而当输出晶体管的尺寸设计的较大时,输出阶段时钟信号线的功耗和耦合到上拉节点的噪声都将增大。此外,栅极驱动电路工作在正常温度下时并不需要大尺寸的输出晶体管。

发明内容

本发明的实施例提供一种移位寄存器单元、栅极驱动电路、显示装置及驱动方法,该移位寄存器单元在正常温度和低温下均可以正常工作,且在正常温度下工作时,能减小耦合噪声和节省功耗。

为达到上述目的,本发明的实施例采用如下技术方案:

本发明实施例的第一方面,提供一种移位寄存器单元,包括第一输出子电路和第二输出子电路;所述第一输出子电路连接时钟信号端、控制电压端、上拉节点和输出端;所述第一输出子电路用于在所述控制电压端和所述上拉节点的电压的控制下,将所述时钟信号端的信号输出至所述输出端;所述第二输出子电路连接所述时钟信号端、所述上拉节点和所述输出端;所述第二输出子电路用于在所述上拉节点的电压的控制下,将所述时钟信号端的信号输出至所述输出端。

可选的,所述第一输出子电路包括第一晶体管、第二晶体管和第三晶体管;所述第一晶体管的栅极连接所述控制电压端,所述第一晶体管的第一极连接所述第二晶体管的栅极和所述第三晶体管的栅极,并形成第一节点;所述第一晶体管的第二极连接所述上拉节点;所述第二晶体管的第一极连接所述时钟信号端,所述第二晶体管的第二极连接所述第三晶体管的第一极,并形成第二节点;所述第三晶体管的第二极连接所述输出端。

可选的,所述第二输出子电路包括第四晶体管和第一电容;所述第四晶体管的栅极连接所述上拉节点,所述第四晶体管的第一极连接所述时钟信号端,所述第四晶体管的第二极连接所述输出端;所述第一电容的一端连接所述上拉节点,所述第一电容的另一端连接所述输出端。

可选的,所述第一输出子电路还包括第五晶体管和第六晶体管;所述第五晶体管的栅极和所述第六晶体管的栅极连接降噪信号端,所述第五晶体管的第一极连接所述第二节点,所述第六晶体管的第一极连接所述第一节点,所述第五晶体管的第二极和所述第六晶体管的第二极连接所述第一电压端。

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